$A.8.1:D触发器，寄存器 D Master Slave (Data) 0 Clock C C Clock D锁存器：ck电平控制 一位D触发器：ck边沿控制 Preset Preset 数据输入 数据输出 数据使能 D触发器 时钟 Clear 复位 带清零Clear和预置Preset的D触发器 一位寄存器，数据使能=write,clk$A.8.1：D触发器，寄存器 D 锁存器：clk电平控制 一位 D 触发器：clk边沿控制 ＝ ＝ 带清零Clear和预置Preset的D 触发器 一位寄存器，数据使能=write，clk