累加器暂存寄存器ACT采用74377,CG为低电平且接数 控制脉冲CC电平正跳时,AT接数。ACT的输出不受控制地 直接加在ALU的A组输入端参加运算。 暂存器TMP采用三态输出锁存器74373。当它的接数控 制端CT为高电平时,接收内部数据总线工DB上的信息:当它 的输出控制端OT为低电平时,其所存信息加到ALU的B组输 入端参加运算。在构造运算器时,若只需控制TMP的输出, 则可将C接+5V:若不需TMP暂存信息,则可将CT接+5V OT接地,使其直通,若OT接+5V,则TMP输出高态°累加器暂存寄存器ACT采用74377，CG为低电平且接数 控制脉冲CC电平正跳时，ACT接数。ACT的输出不受控制地 直接加在ALU的A组输入端参加运算。 暂存器TMP采用三态输出锁存器74373。当它的接数控 制端CT为高电平时，接收内部数据总线IDB上的信息;当它 的输出控制端OT为低电平时，其所存信息加到ALU的B组输 入端参加运算。在构造运算器时，若只需控制TMP的输出， 则可将CT接+5V;若不需TMP暂存信息，则可将CT接+5V、 OT接地，使其直通，若OT接+5V，则TMP输出高阻态