点击下载:襄樊职业技术学院:《在系统编程技术》第9讲 VHDL语言的基本结构
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1、实体 格式: ENTITY实体名1S GENERIC(类属表); [PORT(端口表);] END实体名; 说明所设计的逻辑电路的输入输出信号及其特性 (输入、输出、双向)1、实 体 格式: ENTITY 实体名 IS [GENERIC ( 类属表 );] [PORT ( 端口表 );] END 实体名; 说明所设计的逻辑电路的输入输出信号及其特性 (输入、输出、双向)
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