8086/8088cPU的一个基本总线周期由4个时钟周期(T1,T2 状态和T4状态。每一个时钟周期(时钟状态)内完成一些基本交 3,T4)组成,时钟周期也称为时钟状态,即T1状态、T2状态 例如: 在T1状态,CPU往数据/地址多路复用总线上发出访问存储器或 O端口的地址信息。 在T2状态,CPU从总线上撤销地址,若为读周期发出“RD控制 信号,使数据/地址多路复用总线的低8位处于高阻抗状态,以便CPU 高简总坐搜技姦转奢为商斯楼套利号,由 于输出数据和输出地址都是写总线过程,因而不需要缓冲时间,CPU 在T2~T4期间把数据放到总线上。 在T3状态,数据地址分时复用线的低8位上出现由CPU输出的数 据或为CPU从存储器或O端口读入的数据 在T4状态,8088完成数据传送,是控制信号变为无效,结束总 线周期。 退出5.1.1 8086/8088CPU的一个基本总线周期由4个时钟周期（T1，T2， T3，T4）组成，时钟周期也称为时钟状态，即T1状态、T2状态、T3 状态和T4状态。每一个时钟周期（时钟状态）内完成一些基本操作。 例如： 在T1状态，CPU往数据/地址多路复用总线上发出访问存储器或 I/O端口的地址信息。 在T2状态，CPU从总线上撤销地址，若为读周期发出“RD”控制 信号，使数据/地址多路复用总线的低8位处于高阻抗状态，以便CPU 有足够的时间从输出地址方式转变为输入数据方式，接着在T3～T4 期间，CPU从总线上接收数据。若为写周期发出“WR”控制信号，由 于输出数据和输出地址都是写总线过程，因而不需要缓冲时间，CPU 在T2～T4期间把数据放到总线上。 在T3状态，数据/地址分时复用线的低8位上出现由CPU输出的数 据或为CPU从存储器或I/O端口读入的数据。 在T4状态，8088完成数据传送，是控制信号变为无效，结束总 线周期。 退 出