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电子科技大学:《VHDL语言与数字集成电路设计》第三章 数字集成电路的设计形式
文档格式:PPT 文档大小:1.47MB 文档页数:30
数字集成电路的设计形式 全定制设计(ASIC或基于标准单元的设计(CBIC) 半定制设计或基于门阵列的设计(GA) 基于可编程器件(PLD)的设计;
电子科技大学:《VHDL语言与数字集成电路设计》第四章 数字集成电路的设计流程
文档格式:PPT 文档大小:452KB 文档页数:22
数字集成电路的设计流程 设计输入:以电路图或HDL语言的形式形成 电路文件;输入的文件经过编译后,可以 形成对电路逻辑模型的标准描述; 逻辑仿真(功能仿真):对如上形成的逻 辑描述加入输入测试信号,检查输出信号 是否满足设计要求;在此没有考虑任何时 间关系,只是检测逻辑是否有错;
电子科技大学:《VHDL语言与数字集成电路设计》数字逻辑1-1
文档格式:PPT 文档大小:212KB 文档页数:16
Chapter 1: Introduction From analog to digital Digital circuits and devices Design for IC The target of the text The arrangement of the text
电子科技大学:《VHDL语言与数字集成电路设计》数字逻辑2-1
文档格式:PPT 文档大小:216KB 文档页数:14
Chapter 2 Number systems and codes Positional number system representation and conversion Representations of negative numbers BCD codes and gray code
电子科技大学:《VHDL语言与数字集成电路设计》数字逻辑2-2
文档格式:PPT 文档大小:159KB 文档页数:12
Representations of signed numbers In binary systems, an n-bit string can represent 2n different numbers 01234567
电子科技大学:《VHDL语言与数字集成电路设计》数字逻辑3-1
文档格式:PPT 文档大小:390.5KB 文档页数:14
电子科技大学:《VHDL语言与数字集成电路设计》数字逻辑3-1
电子科技大学:《VHDL语言与数字集成电路设计》数字逻辑3-2
文档格式:PPT 文档大小:356KB 文档页数:14
Electrical behavior of cmos Steady-state behavior when output is hold on 1 or 0 Dynamic behavior when output is changing
电子科技大学:《VHDL语言与数字集成电路设计》数字逻辑3-3
文档格式:PPT 文档大小:1.69MB 文档页数:16
How to make a better device Good performance faster and less power consumed Low cost more compact and use less area
电子科技大学:《VHDL语言与数字集成电路设计》数字逻辑2-3
文档格式:PPT 文档大小:212KB 文档页数:13
Codes in binary system BCD codes: for decimal digit Gray code: for numbers in binary system; AsCIi code: for characters ey point Use n bits. we can make 2n different words: To make n code-words. you must use logn bits
电子科技大学:《VHDL语言与数字集成电路设计》第五章 数字集成电路的设计流程
文档格式:PPT 文档大小:481.5KB 文档页数:30
数字集成电路的设计流程 设计输入:以电路图或HDL语言的形式形成 电路文件;输入的文件经过编译后,可以 形成对电路逻辑模型的标准描述; 逻辑仿真(功能仿真):对如上形成的逻 辑描述加入输入测试信号,检查输出信号 是否满足设计要求;在此没有考虑任何时 间关系,只是检测逻辑是否有错;
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