6.1 存储器 6.1.1 ROM (Read-Only Memory) 6.1.2 随机存取存储器 (RAM) 6.2 可编程逻辑器件（PLD) 6.2.1 可编程阵列逻辑(PAL) 6.2.2 通用阵列逻辑(GAL) 6.2.3 PLD的开发过程 6.3 VHDL语言 6.3.1 VHDL基本结构与语法 6.3.1.1 VHDL的组成 6.3.1.2 实体（Entity) 6.3.1.3 结构体 (Architecture) 6.3.1.4 程序包 (Package) 与 USE 语句 6.3.1.5 库 (Library) 6.3.1.6 VHDL运算符 6.3.1.7 数据对象 6.3.1.8 VHDL常用语句 6.3.1.9 元件及元件例化 6.3.1.10 配置 (configuration) 6.3.1.11 子程序 6.3.1.12 其他：属性、时钟的表示 6.3.1.13 VHDL的模板 6.3.1.14 常见错误 6.3.1.15 保留字

4.2 存储器件 4.1 时序逻辑电路的基本概念 4.1.1 时序逻辑电路的结构模型 4.1.2 状态表和状态图 4.3 锁存器 4.3.1 RS锁存器 4.3.2 门控RS锁存器 4.3.3 D锁存器 4.4 触发器 4.4.1 主从触发器 4.4.2 边沿触发器 4.5 触发器逻辑功能的转换 4.5.1 代数法 4.5.2 图表法 4.6 触发器应用举例

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