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《人机交互技术》课程教学资源(PPT课件讲稿)第2章 认知心理学与人机工程学
文档格式:PPT 文档大小:1.05MB 文档页数:100
一、认知的多个过程,包括感知、关注、记忆、学习、识别、阅读、说话和聆听、规划、推理和决策 二、认知特点对交互界面设计的影响 三、认知的概念框架 四、人机工程学与人机界面设计 五、人机交互技术编写组
《生产管理学》教案8
文档格式:DOC 文档大小:50KB 文档页数:3
握批量生产零件的移动方式中的时间计算,大 教学量、成批、单件生产类型信息系统设计中的期量标准 目标的计算等 批量生产零件的移动方式中的时间计算,大量 教学 重点成批、单件生产类型信息系统设计中的期量标准的计 算等
武汉科技大学(武汉科技学院):《微机原理与汇编语言》课程教学资源(PPT课件)第九章 可编程并行接口芯片Intel 8255A
文档格式:PPT 文档大小:427KB 文档页数:35
1. Intel 8255A是一个通用的可编程的并行接口芯片,内部有2个8位I/O口(A、B),两个4位I/O口(PC7~4、PC3~0). 2. 通过编程可设置3种工作方式,可适用于CPU与I/O设备之间的多种数据传送方式的要求
华为:《编程规范与案例》软件编程规范培训实例与练习
文档格式:DOC 文档大小:326.5KB 文档页数:70
1 逻辑类问题(A类)-指设计、编码中出现的计算正确性和一致性、程 序逻辑控制等方面出现的问题,在系统中起关键作用,将导致软件死机、功能正 常实现等严重问题; 接口类问题(B类)-指设计、编码中出现的函数和环境、其他函数、全 局/局部变量或数据变量之间的数据/控制传输不匹配的问题,在系统中起重要作 用,将导致模块间配合失效等严重问题;
《DreamweaverMX2004》66 在框架中使用链接
文档格式:PPT 文档大小:110.5KB 文档页数:1
在框架中使用链接 在框架中使用链接的具体操作步骤如下: (1)选定要链接的文本,打开属性面板。 (2)单击“链接”框右端的图标,打开“选择文件”对话框,选择链接文件,单击“确认”按钮,此时即为选择的文本设置了链接。 (3)按下F12键,打开预览窗口,单击设置了链接的文本,即可链接到目标文件
《DreamweaverMX2004》44 电子邮件的链接
文档格式:PPT 文档大小:110.5KB 文档页数:1
设置电子邮件链接的方法如下: (1)选择要设置电子邮件链接的文本,或将光标放到要插入电子邮件链接的位置。执行下列操作方法之一: 选择“插入”>“电子邮件链接”命令。 单击“常用”子面板上的“Email链接”按钮。 (2)在“文本”框中输入邮件链接要显示在页面上的文本;在 E-mail文本框中输入要链接的邮箱地址
《机械设计基础》课程PPT教学课件(讲稿)第十五章 带传动和链传动
文档格式:PPT 文档大小:4.04MB 文档页数:67
15-1 带传动概述 15-2 V带和V带轮 15-3 带的传动的工作情况分析 15-4 V带传动的设计计算 15-5 V带传动的张紧装置 15-6 链传动的基本知识 15-7 滚子链传动的设计计算 15-8 链传动的布置、张紧和润滑
《DreamweaverMX2004》23 站点地图
文档格式:PPT 文档大小:112.5KB 文档页数:1
利用站点地图,可以以图表的方式查看站点结构。如果没有设置网站的首页,则无法 显示站点地图。设置首页之前,应该确定已存在网页。一切准备就绪后,即可以通过 下面几种方法查看站点地图 ◇单击“站点”>“站点地图”命令 ◇单击“站点”子面板上的“视图”>“站点地图”命令 ◇单击“站点”子面板上“本地视图”文本框下拉列表中的“地图视图”。 ◇按At+F8组合键
《机械设计基础》课程PPT教学课件(讲稿)第七章 凸轮机构
文档格式:PPT 文档大小:1.66MB 文档页数:40
7-1 凸轮机构的应用和类型 7-2 从动件的常用运动规律 7-3 凸轮机轮廓曲线的设计 7-4 凸轮设计应注意的几个问题
北京大学微电子学系:《数字集成电路设计入门——从HDL到版图》课程教学资源(PPT课件讲稿)第六章 Verilog的数据类型及逻辑系统、第七章 结构描述(structural modeling)、第八章 延时模型、第九章 编译控制的使用
文档格式:PPT 文档大小:685KB 文档页数:96
第六章 Verilog的数据类型及逻辑系统 • 学习Verilog逻辑值系统 • 学习Verilog中不同类的数据类型 • 理解每种数据类型的用途及用法 • 数据类型说明的语法 第7章 结构描述(structural modeling) • 如何使用Verilog的基本单元(primitives) • 如何构造层次化设计 • 了解Verilog的逻辑强度系统 第8章 延时模型 学习内容: 1. 如何说明块延时 2. 如何说明分布延时 3. 如何说明路径延时 4. 怎样在模块中说明时序检查 5. 标准延时格式SDF(Standard Delay Format) 第九章 编译控制的使用 • 开发商提供的Verilog库 • 用Verilog库仿真 • Verilog源代码加密 • 其它仿真器相关的问题
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