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电子科技大学:《VHDL语言与数字集成电路设计》数字逻辑2-3
文档格式:PPT 文档大小:212KB 文档页数:13
Codes in binary system BCD codes: for decimal digit Gray code: for numbers in binary system; AsCIi code: for characters ey point Use n bits. we can make 2n different words: To make n code-words. you must use logn bits
电子科技大学:《VHDL语言与数字集成电路设计》数字逻辑2-1
文档格式:PPT 文档大小:216KB 文档页数:14
Chapter 2 Number systems and codes Positional number system representation and conversion Representations of negative numbers BCD codes and gray code
电子科技大学:《VHDL语言与数字集成电路设计》VHDL作业安排
文档格式:DOC 文档大小:32.5KB 文档页数:3
VDL语言与数字集成电路设计 课程习题安排
电子科技大学:《VHDL语言与数字集成电路设计》第八章 VHDL的构造体:architecture
文档格式:PPT 文档大小:153.5KB 文档页数:33
构造体语法要点 每个构造体必须属于一个实体; 每个构造体必须有一个名称: 通常可以根据描述方式起名: str rtl beh 构造体分为两部分: is- bigin:说明语句 bigin-end:并行语句;
电子科技大学:《VHDL语言与数字集成电路设计》第六章 逻辑综合
文档格式:PPT 文档大小:212.5KB 文档页数:28
逻辑综合 逻辑综合将HD语言编写的行为模型转换 为电路结构模型(网表) 这种转换类似于C语言的编译器将C语言转 换为机器语言(二进制语言);
电子科技大学:《VHDL语言与数字集成电路设计》第四章 数字集成电路的设计流程
文档格式:PPT 文档大小:452KB 文档页数:22
数字集成电路的设计流程 设计输入:以电路图或HDL语言的形式形成 电路文件;输入的文件经过编译后,可以 形成对电路逻辑模型的标准描述; 逻辑仿真(功能仿真):对如上形成的逻 辑描述加入输入测试信号,检查输出信号 是否满足设计要求;在此没有考虑任何时 间关系,只是检测逻辑是否有错;
电子科技大学:《VHDL语言与数字集成电路设计》第二十章 VHDL 与 Verilog HDL 的对比
文档格式:PPT 文档大小:280KB 文档页数:30
VHDL与 Verilog HDL的对比 1.整体结构 VHDL Verilog HDL entity实体名 is module模块名(端口表ort(端口说明)输入/输出端口说明
《网络综合布线系统与施工技术》课程教学资源(学习资料)第1章 综合布线系统
文档格式:PDF 文档大小:422.44KB 文档页数:13
建筑物综合布线系统( Premises Distribution System,pds的兴起与发展,是在计算机技 术和通信技术发展的基础上进一步适应社会信息化和经济国际化的需要,也是办公自动化进一 步发展的结果。它也是建筑技术与信息技术相结合的产物,是计算机网络工程的基础
电子科技大学:《VHDL语言与数字集成电路设计》第二章 数字集成电路的结构特点
文档格式:PPT 文档大小:684.5KB 文档页数:53
一、MOS晶体管模型 二、组合逻辑基本结构 三、逻辑单元的优化设计 四、组合单元的规模约束问题 五、时序逻辑的时间关系问题
电子科技大学:《VHDL语言与数字集成电路设计》第十八章 有限状态机FSM的设计
文档格式:PPT 文档大小:493.5KB 文档页数:55
有限状态机FSM的设计 一、时序电路的结构与特点
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