I℃总线所支持的高速模式向下兼容快速模式和标准模式，其速度最高可达3.4bit/s, 高速模式除了没有仲裁和时钟同步以外，其总线协议、数据格式和快速模式相同。为了达 3.4Mbit/s的速度，高速模式的器件在sda输出端有一个开漏极缓冲器，在SCL瑞有开漏极 下拉电路和电流源上拉电路。电流源电路是为了减少SCL的上升时间，并且只有在高速模 式下，该电路才会起作用。为了加快数据处理速度，每一个master都分配了一个特定的器 件标号，总线仲裁的过程是在快速模式下传输master器件标号时完成的。 高速模式在出现下列条件后才开始 1.起始信号 2.8位master器件标号3.非应答位 在非应答位后，SCL回到高电平，master将转成高速模式并开启电流源上拉电路.如果 slave要延迟数据传输，就必须在特定时刻之前延长SCL信号的低电平周期，当slave释放 SCL以后，master开启电流源上拉电路，减少SCL信号的上升时间。在每一个重复起始信号 和一个应答或非应答信号之后，master将关闭电流源上拉电路，slave这时可以延长SCL 信号的低电平周期从而延迟数据传输。当slave都释放了SCL以后，主控器将开启电流源 上拉电路，从而减少SCL信号的最后部分的上升时间。高速模式只有在出现停止信号后才 被关闭。 8位Master标号00001Xx 2 to 5 快速模式 7位地址 R/i n*8位数据+A 凡凡RAAT 如果是停止信号 高速模式 恢复快速模式 如果是重复起始信号 继线高速模式 =CS电流源上拉电路 图2-7I℃总线高速模式的数据传输 =R即上拉电阻 7  
    
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