基本原则之一：面积和速度的平衡与互换； 基本原则之二：硬件原则； 基本原则之三：系统原则； 基本原则之四：同步设计原则； 基本设计思想与技巧之一：乒乓操作； 基本设计思想与技巧之二：串并转换； 基本设计思想与技巧之三：流水线操作； 基本设计思想与技巧之四：数据接口的同步方法； 常用模块之一：RAM; 常用模块之二：全局时钟资源与时钟锁相环； 常用模块之三：全局复位/置位信号； 常用模块之四：高速串行收发器。 HDL语言的层次含义； ·Coding Style的含义； ·结构层次化编码； ·模块的划分的技巧； 比较判断语句case和if...else的优先级； 慎用锁存器(Latch); ·使用Pipelining方法优化时序； 模块复用与Resource Sharing; 逻辑复制； 香农扩展； 信号敏感表； 复位逻辑； FSM设计的一般型原则； 用Verilog语言设计FSM的技巧； ·CPLD原理与设计方法

通信与信息工程系 综合、设计性实验指导书 课程名称:可编程ASIC原理 实验项目名称:数字钟设计 一、实验目的与要求: (1)、使用VHDL语言或 Verilog语言设计数字钟。 (2)、正确选择实验箱的工作模式。 (3)、正确配置FPGA的引脚。 (4)、实验前预习数字钟原理

实验准备及常规仪器设备使用 分立元件及负反馈放大电路设计 测量放大器 晶体管输出特性曲线测试电路 模拟乘法器及调幅与检波电路 LC三点式振荡器 数字电路的FPGA应用实验 脉冲电路及其应用 综合实验 锁相环及频率调制与解调电路 运放基本应用电路

1、锁相环及频率调制与解调电路 2、乙类功率放大器 3、数字电路的FPGA应用实验 4、脉冲电路及其应用 5、综合实验

1、掌握DDS组成实现原理。 2、掌握相位累加器、波形查找表实现原理和时序关系。 3、基于FPGA和DAC模块，设计一个频率可变的信号输出

设计与实现一个数字下变频器(DDC)，完成系统结构及其组成模块的设计与实现，利用MATLAB开展系统级和模块级的进行仿真，编写FPGA程序，对硬件算法进行仿真，最后在实验平台验证设计结果

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无线传感器网络是典型的网络化嵌入式系统,由于其既涉及嵌入式系统的行为又涉及网络的行为,以及其应用相关性,使其测试调试变得困难复杂,无法构建一个通用的测试调试平台.为有效地测试调试无线传感器网络,在分析已有的研究工作基础上,采用半实物的仿真策略,提出了一种混合方式的无线传感器网络测试调试系统,解决了纯粹软件仿真平台掩盖太多实际器件实现的细节和实际环境测试中嵌入式系统行为和网络行为不可见、不可控性的缺陷,达到了一种折中的效果.最后给出了该系统在FPGA(field programmable gate array)上的实现实例;通过实验验证了该系统能够有效地对无线传感器网络应用进行测试调试