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西安交通大学:《工程训练之—工业系统的测量》工业系统测量课程设计说明
文档格式:DOC 文档大小:77KB 文档页数:3
1、设计任务 设计一个测量系统(或者加入控制部分,构成测控系统)并实现它,最后要对系统进行校准。要求包括完整的设计,含传感器、信号调理电路、数字显示以及电源部分,如下图:
《电子电工》课程教学资源(文献资料)Xilinx FPGA-Verilog(学习资料)
文档格式:PDF 文档大小:71.9MB 文档页数:171
第 1 章 概述.1 1.1 数字逻辑.1 1.2 Verilog. 2 第 2 章 基本逻辑门.3 2.1 真值表和逻辑表达式.3 2.1.1 三种基本逻辑门.3 2.1.2 四种常用逻辑门.4 2.2 基于乘积和的设计.6 2.3 基于和项积的设计.8 第 3 章 现场可编程门阵列(FPGA). 21 第 4 章 Basys2 原理图. 25 第 5 章 组合逻辑.32 第 6 章 运算电路.83 第 7 章 时序电路. 110 附录 A 代码仿真及设计实现. 161
电子科技大学:《VHDL语言与数字集成电路设计》第十七章 时序运算模块的ⅥHDL设计
文档格式:PPT 文档大小:181.5KB 文档页数:25
时序电路的结构与特 内部含有存储器件(触发器、锁存器); 信号变化受时钟控制; 通常采用状态变化进行描述; 采用进程进行设计;
南京邮电大学:《数字电路与系统设计》课程教学资源(PPT课件讲稿)第六章 时序逻辑电路(3/7)
文档格式:PPT 文档大小:1.24MB 文档页数:44
一、寄存器 寄存器常用于寄存一组二值代码,它被广泛 地用于各类数字系统和数字计算机。 从广义上说寄存器也是一种存储器,但是 它又不同于第九章介绍的半导体存储器。 寄存器的特点: 存数方便,但容量小,一般只能存放一个 或几个字,通常用来暂存运算的中间结果,而 且一旦掉电,存放的数据即丢失
电子科技大学:《电子设计自动化技术》课程教学资源(讲义课件)简单数字系统的 VHLD 应用设计
文档格式:PDF 文档大小:88.18KB 文档页数:9
电路要求 kbencoder 数据输入 i[7..0] 低电平有效 控制输入 el 低电平有效 数据输出 a[2..0] 反函数输出:表达最高位优先编码 数据输出 b[2..0] 反函数输出:表达次高位优先编码 设计思想:
电子科技大学:《VHDL语言与数字集成电路设计》第十二章 VHDL中的结构设计:元件例化语句
文档格式:PPT 文档大小:154.5KB 文档页数:26
设计的要点:建立元件端口之间的连接; 元件:已经定义的电路模块(实体),可以 来自标准库中,也可以是自己或他人以前编 译过的实体; 元件的基本要点: 元件名输入/输出端口特点;
电子科技大学:《电子设计自动化技术》课程教学资源(讲义课件)第三章 数字集成电路的设计过程(Top-down)
文档格式:PDF 文档大小:305.86KB 文档页数:7
系统设计:芯片的功能、尺寸、外部接口、 性能、速度、成本等; 功能设计:系统功能块分割、功能框图 信号流程图、状态转换图等 逻辑设计:各功能块的逻辑表达、逻辑电路图等 功能仿真:不考虑电路连线延时
北京大学:《集成电路原理与设计 Principle of Integrated Circuits》课程电子教案(数字集成电路原理与设计)chap5-3 第5章 数字集成电路基本模块 5.3 时序单元电路
文档格式:PDF 文档大小:1.48MB 文档页数:32
北京大学:《集成电路原理与设计 Principle of Integrated Circuits》课程电子教案(数字集成电路原理与设计)chap5-3 第5章 数字集成电路基本模块 5.3 时序单元电路
北京大学:《集成电路原理与设计 Principle of Integrated Circuits》课程电子教案(数字集成电路原理与设计)chap5-4 第五章 数字集成电路中的基本模块 5.4 时序模块电路
文档格式:PDF 文档大小:1.6MB 文档页数:21
北京大学:《集成电路原理与设计 Principle of Integrated Circuits》课程电子教案(数字集成电路原理与设计)chap5-4 第五章 数字集成电路中的基本模块 5.4 时序模块电路
北京大学:《集成电路原理与设计 Principle of Integrated Circuits》课程电子教案(数字集成电路原理与设计)chap5-1 第五章 数字集成电路基本模块 5.1 组合逻辑电路
文档格式:PDF 文档大小:1.12MB 文档页数:21
北京大学:《集成电路原理与设计 Principle of Integrated Circuits》课程电子教案(数字集成电路原理与设计)chap5-1 第五章 数字集成电路基本模块 5.1 组合逻辑电路
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