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清华大学:《逻辑设计与数字系统》课程教学资源(PPT课件)脉冲型异步时序电路的分析与设计
文档格式:PPT 文档大小:288.5KB 文档页数:14
可采用与同步时序电路设计的方法,应注意时钟脉冲的选取 例用D触发器设计x1
南京邮电大学:《数字电路与系统》课程教学资源(PPT课件讲稿)第六章 时序逻辑电路(6.3)复杂时序电路的设计
文档格式:PPT 文档大小:1.58MB 文档页数:68
一、同步时序电路的设计 1.设计步骤 (1)建立原始状态表和状态图 原始的含义:是指没有经过简化而获得的状态 转移表和状态转移图。 对于原始状态表和状态图的要求是: 保证其绝对的正确性,确保状态无遗漏, 状态转移关系的正确
吉林大学:《数字逻辑电路》课程教学资源(PPT课件讲稿)第六章 同步时序逻辑电路 6.5 同步时序逻辑电路的设计(2/3)
文档格式:PPT 文档大小:585KB 文档页数:34
6.5.5同步时序逻辑电路设计举例 例: 设计一个“11.序列检测器,用来检测串行二进制序列,要求每当连续输入3个(或3个以上)1时,检测器输出为1,否则输出为0。其典型输入输出序列如下: 输入x:0111011110 输出Z:0001000110
北京大学:《集成电路原理与设计 Principle of Integrated Circuits》课程电子教案(数字集成电路原理与设计)chap2-2 第二章 集成电路制作工艺 2.3 寄生效应和SOI工艺
文档格式:PDF 文档大小:3.28MB 文档页数:35
2.3.1 CMOS IC中的寄生效应 2.3.2 SOI工艺 2.3.3 CMOS版图设计规则
北京大学:《集成电路原理与设计 Principle of Integrated Circuits》课程电子教案(数字集成电路原理与设计)chap6 第六章 CMOS I/O设计
文档格式:PDF 文档大小:2.3MB 文档页数:41
6.1 输入缓冲器 6.2 输出缓冲器 6.3 ESD保护电路 6.4 三态输出的双向I/O缓冲器
重庆大学:《数字电子技术基础》课程教学资源(课程设计教学大纲)
文档格式:DOC 文档大小:33KB 文档页数:2
设计可控的计数器、寄存器、译码及显示驱动电路。 设计系统顶层电路 进行功能仿真和时序仿真
中国科学技术大学:《数字逻辑电路》课程教学资源(课件讲稿)第四章 组合逻辑电路
文档格式:PDF 文档大小:1.13MB 文档页数:33
4.1 概述 4.2 组合逻辑电路的分析方法 4.3 组合逻辑电路的基本设计方法 4.4 若干常用的组合逻辑电路模块 4.5 层次化和模块化的设计方法 4.6 可编程逻辑器件 4.7 硬件描述语言 4.8 用可编程通用模块设计组合逻辑电路 4.9 组合逻辑电路中的竞争-冒险
沈阳师范大学:《数字媒体技术》课程教学课件(讲稿)第九章 多媒体应用系统开发
文档格式:PDF 文档大小:7.25MB 文档页数:143
一、多媒体应用系统 六、多媒体对象的添加 二、超文本与超媒体 七、演示文稿动画的设计 三、多媒体创作工具 八、演示文稿的交互设计 四、多媒体演示系统设计 九、演示文稿发布打包 五、多媒体演示文稿制作
西安交通大学:《工程训练之—工业系统的测量》工业系统测量课程设计说明
文档格式:DOC 文档大小:77KB 文档页数:3
1、设计任务 设计一个测量系统(或者加入控制部分,构成测控系统)并实现它,最后要对系统进行校准。要求包括完整的设计,含传感器、信号调理电路、数字显示以及电源部分,如下图:
《电子电工》课程教学资源(文献资料)Xilinx FPGA-Verilog(学习资料)
文档格式:PDF 文档大小:71.9MB 文档页数:171
第 1 章 概述.1 1.1 数字逻辑.1 1.2 Verilog. 2 第 2 章 基本逻辑门.3 2.1 真值表和逻辑表达式.3 2.1.1 三种基本逻辑门.3 2.1.2 四种常用逻辑门.4 2.2 基于乘积和的设计.6 2.3 基于和项积的设计.8 第 3 章 现场可编程门阵列(FPGA). 21 第 4 章 Basys2 原理图. 25 第 5 章 组合逻辑.32 第 6 章 运算电路.83 第 7 章 时序电路. 110 附录 A 代码仿真及设计实现. 161
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