第5章通用时序电路模块及应用 5.4计数器 一、计数器是按预定状态序列变化以表征触发时钟脉冲输入个数的时序逻辑模块。 二、计数器主要由触发器构成,附加逻辑除使触发器按预定状态序列变化,还使计数器具有清0、使能、加载等功能。 三、在数据的寄存上寄存器与计数器相似。寄存器着重于数据的存储与操作,计数器强调数据序列变化,其在数字系统的操作控制方面有重要应用

《数字电路与逻辑设计》课程实验指导（数字电路实验）实验五 触发器及其应用

《数字电路与逻辑设计》课程实验指导（数字电路实验）实验七 计数器及其应用

《数字电路与逻辑设计》课程实验指导（数字电路实验）实验五 触发器及其应用

《数字电路与逻辑设计》课程实验指导（数字电路实验）实验七 计数器及其应用

《数字电路与逻辑设计》课程实验指导（数字电路实验）实验八 移位寄存器及其应用

《数字电路与逻辑设计》课程实验指导（数字电路实验）实验八 移位寄存器及其应用

《数字电路与逻辑设计》课程实验指导（数字电路实验）实验六 小规模SSI计数器及其应用

《数字电路与逻辑设计》课程实验指导（数字电路实验）实验六 小规模SSI计数器及其应用

《数字电路与逻辑设计》课程各章习题（含解答）第八章 可编程逻辑器件及其应用