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《人力资源管理》课程教学资源(PPT课件)第四章 工作分析与工作设计
文档格式:PPT 文档大小:92.5KB 文档页数:25
一、工作分析概述 二、收集工作分析信息的方法 三、工作设计 四、工作描述和工作说明书
《城市设计理论与实践》第六讲 城市设计的理论思潮
文档格式:PPT 文档大小:23.57MB 文档页数:93
面对大城市发展的困境,E.霍华德 和勒·柯市西埃提出了两种截然相反的解 决方法。前者倾向于人口分散,实现 “田园城市”的理想;后者倾向于人口 集中,主张以先进的工业技术发展和改 造大城市。芬兰建筑师伊利尔沙里宁 (Eliel Saarinen)(1873-1950年)提出了一种 介于二者之间又区别于二者的思想—有 机疏散”理论
武汉科技大学(武汉科技学院):《微机原理与汇编语言》课程教学资源(PPT课件)第九章 可编程并行接口芯片Intel 8255A
文档格式:PPT 文档大小:427KB 文档页数:35
1. Intel 8255A是一个通用的可编程的并行接口芯片,内部有2个8位I/O口(A、B),两个4位I/O口(PC7~4、PC3~0). 2. 通过编程可设置3种工作方式,可适用于CPU与I/O设备之间的多种数据传送方式的要求
华为:《编程规范与案例》软件编程规范培训实例与练习
文档格式:DOC 文档大小:326.5KB 文档页数:70
1 逻辑类问题(A类)-指设计、编码中出现的计算正确性和一致性、程 序逻辑控制等方面出现的问题,在系统中起关键作用,将导致软件死机、功能正 常实现等严重问题; 接口类问题(B类)-指设计、编码中出现的函数和环境、其他函数、全 局/局部变量或数据变量之间的数据/控制传输不匹配的问题,在系统中起重要作 用,将导致模块间配合失效等严重问题;
《网页制作宝典》第4章 网页表格的处理
文档格式:PPT 文档大小:130.5KB 文档页数:19
通过本章学习,应该掌握以下内容: 1.利用 FrontPage2002创建表格的四种方法 2.编辑表格的方法 3.设置表格的属性的方法 4.用表格设计页面布局 5.利用HTML和 Dreamweaver4.0创建表格的方法
《生产管理》PPT教学课件:第2章 生产系统设计
文档格式:PPT 文档大小:1.92MB 文档页数:51
2.1产品与工艺设 2.2厂址选择与趋势 2.3三流统一的生产过程 2.4生产类型及其选择 2.5生过程的空间和时间组织 2.6柔性制造系统
《机械设计基础》课程PPT教学课件(讲稿)第十五章 带传动和链传动
文档格式:PPT 文档大小:4.04MB 文档页数:67
15-1 带传动概述 15-2 V带和V带轮 15-3 带的传动的工作情况分析 15-4 V带传动的设计计算 15-5 V带传动的张紧装置 15-6 链传动的基本知识 15-7 滚子链传动的设计计算 15-8 链传动的布置、张紧和润滑
《数字系统与VHDL程序设计语言》课程教学资源(PPT课件讲稿,共六章)
文档格式:PPT 文档大小:6.46MB 文档页数:200
第一章VHDL的程序结构和软件操作 1-1 VHDL程序的基本结构 1-2软件操作—Max+plusⅡ的操作 第二章 VHDL语言要素 第三章 VHDL顺序语句 第四章 VHDL并行语句 4.1 并行语句概述 4.2 并行信号赋值语句 4.3 进程语句(process) 4.4 元件例化语句 4.5 生成语句(for-generate) 第五章 组合逻辑电路的设计和分析 5.1 概述 5.2 编码器 5.3 译码器 5.4 简单数字显示系统 5.5 其它 第六章 时序逻辑电路的设计和分析 6.2 触发器 6.3 计数器 6.4 分频器 6.5 寄存器 6.1 概述
《机械设计基础》课程PPT教学课件(讲稿)第七章 凸轮机构
文档格式:PPT 文档大小:1.66MB 文档页数:40
7-1 凸轮机构的应用和类型 7-2 从动件的常用运动规律 7-3 凸轮机轮廓曲线的设计 7-4 凸轮设计应注意的几个问题
北京大学微电子学系:《数字集成电路设计入门——从HDL到版图》课程教学资源(PPT课件讲稿)第六章 Verilog的数据类型及逻辑系统、第七章 结构描述(structural modeling)、第八章 延时模型、第九章 编译控制的使用
文档格式:PPT 文档大小:685KB 文档页数:96
第六章 Verilog的数据类型及逻辑系统 • 学习Verilog逻辑值系统 • 学习Verilog中不同类的数据类型 • 理解每种数据类型的用途及用法 • 数据类型说明的语法 第7章 结构描述(structural modeling) • 如何使用Verilog的基本单元(primitives) • 如何构造层次化设计 • 了解Verilog的逻辑强度系统 第8章 延时模型 学习内容: 1. 如何说明块延时 2. 如何说明分布延时 3. 如何说明路径延时 4. 怎样在模块中说明时序检查 5. 标准延时格式SDF(Standard Delay Format) 第九章 编译控制的使用 • 开发商提供的Verilog库 • 用Verilog库仿真 • Verilog源代码加密 • 其它仿真器相关的问题
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