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《数字逻辑电路》课程教学资源(实验指导)译码器应用的设计与实例
文档格式:PPT 文档大小:309KB 文档页数:8
《数字逻辑电路》课程教学资源(实验指导)译码器应用的设计与实例
内蒙古科技大学:《数字电子技术》课程教学实验指导书(共八个实验)
文档格式:DOC 文档大小:4.87MB 文档页数:49
实验一 TTL集成逻辑门的逻辑功能与参数测试.1 实验二 组合逻辑电路的设计与测试.8 实验三 译码器及其应用.11 实验四 数据选择器及其应用.18 实验五 触发器及其应用.25 实验六 计数器及其应用.31 实验七 移位寄存器及其应用.37 实验八 555定时电路及其应用.45
《数字逻辑电路》课程教学资源(实验指导)多功能数字钟的设计
文档格式:DOC 文档大小:4.53MB 文档页数:7
《数字逻辑电路》课程教学资源(实验指导)多功能数字钟的设计
南京邮电大学:《数字电路与系统设计》课程教学资源(PPT课件讲稿)第四章 组合逻辑电路(4.2)数据选择器(2/3)
文档格式:PPT 文档大小:2.12MB 文档页数:29
三、数据选择器 MUX:称为多路选择器或多路开关
电子科技大学:《VHDL语言与数字集成电路设计》数字逻辑3-1
文档格式:PPT 文档大小:390.5KB 文档页数:14
电子科技大学:《VHDL语言与数字集成电路设计》数字逻辑3-1
电子科技大学:《VHDL语言与数字集成电路设计》数字逻辑3-2
文档格式:PPT 文档大小:356KB 文档页数:14
Electrical behavior of cmos Steady-state behavior when output is hold on 1 or 0 Dynamic behavior when output is changing
中国地质大学(武汉):《数字逻辑实验》课程教学资源(实验内容)实验十 数字定时器(设计性)
文档格式:PDF 文档大小:323KB 文档页数:2
中国地质大学(武汉):《数字逻辑实验》课程教学资源(实验内容)实验十 数字定时器(设计性)
电子科技大学:《VHDL语言与数字集成电路设计》数字逻辑3-3
文档格式:PPT 文档大小:1.69MB 文档页数:16
How to make a better device Good performance faster and less power consumed Low cost more compact and use less area
电子科技大学:《VHDL语言与数字集成电路设计》数字逻辑2-2
文档格式:PPT 文档大小:159KB 文档页数:12
Representations of signed numbers In binary systems, an n-bit string can represent 2n different numbers 01234567
电子科技大学:《VHDL语言与数字集成电路设计》数字逻辑2-1
文档格式:PPT 文档大小:216KB 文档页数:14
Chapter 2 Number systems and codes Positional number system representation and conversion Representations of negative numbers BCD codes and gray code
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