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中国科学技术大学：《超大规模集成电路设计（VLSI）》课程教学资源（设计实验）Cadence IC 设计实验（Diva Interactive Verification）
文档格式：PDF　文档大小：274.88KB　文档页数：10
中国科学技术大学：《超大规模集成电路设计（VLSI）》课程教学资源（设计实验）Cadence IC 设计实验（Diva Interactive Verification）
北京大学微电子学系：《数字集成电路设计入门——从HDL到版图》课程教学资源（PPT课件讲稿）第二章 Verilog应用、第三章 Cadence仿真器、第四章 设计举例、第五章 Verilog的词汇约定（Lexical convention）（于敦山）
文档格式：PPT　文档大小：540.5KB　文档页数：88
一、 使用HDL设计的先进性 二、Verilog的主要用途 三、 Verilog的历史 四、如何从抽象级(levels of abstraction)理解 五、电路设计 六、Verilog描述 – 逻辑仿真算法 – 如何启动Verilog-XL和NC Verilog仿真器 – 如何显示波形 1. 进一步学习Verilog的结构描述和行为描述 2. Verilog混合（抽象）级仿真 1. 理解Verilog中使用的词汇约定 2. 认识语言专用标记(tokens) 3. 学习timescale
北京大学微电子学系：《数字集成电路设计入门——从HDL到版图》课程教学资源（PPT课件讲稿）第二章 Verilog应用、第三章 Cadence仿真器、第四章 设计举例、第五章 Verilog的词汇约定（Lexical convention）（于敦山）
文档格式：PPT　文档大小：540.5KB　文档页数：88
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