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清华大学:《逻辑设计与数字系统》课程教学资源(PPT课件)习题1
文档格式:PPT 文档大小:290.5KB 文档页数:16
2-1(a), 2-2(b), 2-3(c), 2-6(c) 3-1,3-2(a), 3-3(b), 3-4(c), 3-5(d), 3-9(a) 请用VHDL语言描述与或非门和异或门
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桂林电子科技大学:《可编程ASIC原理》课程教学资源(实验指导书)实验二 波形输入与仿真实现
文档格式:PDF 文档大小:28.41KB 文档页数:2
实验二波形输入与仿真实现 一、实验目的:通过本次实验掌握波形输入法制作元件的过程,掌握实验箱中时钟和扬声器的具体使用方法以及任意模值计数器的设计方法。 二、实验要求: 1、利用波开输入法设计非门电路模块。 2、利用VHDL语言输入方法设计数据选择器(参考二选一数据选择器程序),编译、定义引脚并下载到实验箱中验证
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电子科技大学:《VHDL语言与数字集成电路设计》第三章 数字集成电路的设计形式
文档格式:PPT 文档大小:1.47MB 文档页数:30
数字集成电路的设计形式 全定制设计(ASIC或基于标准单元的设计(CBIC) 半定制设计或基于门阵列的设计(GA) 基于可编程器件(PLD)的设计;
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国防科技大学&南华大学:《数字电子技术》课程教学资源(PPT课件)第一章 数字逻辑基础
文档格式:PPT 文档大小:3.23MB 文档页数:160
1.1 数制与编码 1.1.1 数制 1.1.2 数制间的转换 1.1.3 编码 1.2 逻辑代数 1.2.1 逻辑变量与逻辑函数的概念 1.2.2 三种基本逻辑及运算 1.2.3 复合逻辑及其运算 1.2.4 逻辑函数的描述 1.2.5 逻辑代数的定律、规则及常用公式 1.3 逻辑函数化简 1.4 VHDL语言描述
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电子科技大学:《VHDL语言与数字集成电路设计》数字逻辑2-3
文档格式:PPT 文档大小:212KB 文档页数:13
Codes in binary system BCD codes: for decimal digit Gray code: for numbers in binary system; AsCIi code: for characters ey point Use n bits. we can make 2n different words: To make n code-words. you must use logn bits
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电子科技大学:《VHDL语言与数字集成电路设计》第十七章 时序运算模块的ⅥHDL设计
文档格式:PPT 文档大小:181.5KB 文档页数:25
时序电路的结构与特 内部含有存储器件(触发器、锁存器); 信号变化受时钟控制; 通常采用状态变化进行描述; 采用进程进行设计;
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桂林电子科技大学:《可编程ASIC原理》课程教学资源(实验指导书)实验一 可编程ASIC使用初步
文档格式:PDF 文档大小:35.37KB 文档页数:2
实验一可编程ASIC使用初步 一、实验目的: 1、过本次实验掌握EDA实验箱的使用方法。 2、将给出的数据选择器、数据比较器等程序下载到实验箱中进一步了解实验箱中按键、发光管、数码管的具体使用方法。 3、掌握常用组合逻辑电路的VHDL语言设计方法
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桂林电子科技大学:《可编程ASIC原理》课程教学资源(实验指导书)实验五 A/D采样电路设计
文档格式:PDF 文档大小:34.06KB 文档页数:3
实验五AD采样电路设计 一、实验目的:通过本次实验掌握用VHDL语言设计程序能够通过时序对ADC0809器件进行控制并进行采集、输出。 二、实验要求: 1、了解并掌握ADC0809的工作原理。 2、编写相应的程序实现对ADC0809的控制
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电子科技大学:《VHDL语言与数字集成电路设计》第二章 数字集成电路的结构特点
文档格式:PPT 文档大小:684.5KB 文档页数:53
一、MOS晶体管模型 二、组合逻辑基本结构 三、逻辑单元的优化设计 四、组合单元的规模约束问题 五、时序逻辑的时间关系问题
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电子科技大学:《VHDL语言与数字集成电路设计》第十六章 组合运算模块的ⅥHDL设计
文档格式:PPT 文档大小:296KB 文档页数:30
在硬件逻辑电路中,实际面对的数据对象总 是逻辑量,能够直接形成的运算是逻辑运算 算术运算可以看作是一种抽象的行为描述 组合运算电路主要包括加法器( adder)和 乘法器( multipliers)
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