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北京大学:《集成电路原理与设计 Principle of Integrated Circuits》课程电子教案(数字集成电路原理与设计)chap5-1 第五章 数字集成电路基本模块 5.1 组合逻辑电路
文档格式:PDF 文档大小:1.12MB 文档页数:21
北京大学:《集成电路原理与设计 Principle of Integrated Circuits》课程电子教案(数字集成电路原理与设计)chap5-1 第五章 数字集成电路基本模块 5.1 组合逻辑电路
江苏大学:《计算机网络课程设计》第一讲 CISCO路由器介绍及常用配置
文档格式:PDF 文档大小:584.5KB 文档页数:33
实训 Cisco路由器认识 1、 Cisco产品介绍 (1)路由器 模块化路由器
电子科技大学:《VHDL语言与数字集成电路设计》第二十章 VHDL 与 Verilog HDL 的对比
文档格式:PPT 文档大小:280KB 文档页数:30
VHDL与 Verilog HDL的对比 1.整体结构 VHDL Verilog HDL entity实体名 is module模块名(端口表ort(端口说明)输入/输出端口说明
吉林师范大学:《Power Builder教案》第10章 通用查询模块
文档格式:PPT 文档大小:818.5KB 文档页数:15
10.0引言 10.1准备工作 10.2全字段查询技术的实 10.3选字段查询窗口的设计
电子科技大学:《VHDL语言与数字集成电路设计》第十三章 VHDL中的子结构
文档格式:PPT 文档大小:87KB 文档页数:19
为了使设计简化,避免重复的工作,VHDL中 通常使用子结构来规范一些常用的运算或简 单的功能模块;
私立华联学院:《Python语言程序设计》课程教学资源(PPT课件)第11单元 Python的模块使用与程序打包
文档格式:PPTX 文档大小:196.6KB 文档页数:13
私立华联学院:《Python语言程序设计》课程教学资源(PPT课件)第11单元 Python的模块使用与程序打包
《Visual FoxPro程序设计教程》第十二章 数据库应用程序实例
文档格式:PPT 文档大小:519.5KB 文档页数:28
一 、系统功能 本系统将实现对设备资产管理的登记、浏览、删除、组 合查询、全屏幕浏览、报表及其打印。系统功能模块如 图所示
《Visual FoxPro 程序设计教程》课程教学资源(PPT课件讲稿)第六章 结构化程序设计
文档格式:PPT 文档大小:1.22MB 文档页数:94
第一节程序文件 第二节程序的基本结构 第三节程序的模块化 第四节程序调试
清华大学电子系:《逻辑设计与数字系统》课程教学讲义(数字电子技术基础)第五章 通用时序电路模块及应用(5-4)计数器
文档格式:DOC 文档大小:236KB 文档页数:15
第5章通用时序电路模块及应用 5.4计数器 一、计数器是按预定状态序列变化以表征触发时钟脉冲输入个数的时序逻辑模块。 二、计数器主要由触发器构成,附加逻辑除使触发器按预定状态序列变化,还使计数器具有清0、使能、加载等功能。 三、在数据的寄存上寄存器与计数器相似。寄存器着重于数据的存储与操作,计数器强调数据序列变化,其在数字系统的操作控制方面有重要应用
《单片机原理与接口技术 Single Chip Microcomputer》教学资源(PPT课件讲稿)第2章 C程序的设计
文档格式:PPT 文档大小:410KB 文档页数:113
C 语言是一种结构化语言。所谓结构化 语言就是不允许交叉程序的存在。结构 化语言的基本元素是模块,在C语言中 也称为函数。它是程序的一部分,只有 一个出口和一个入口,不允许中途插入, 也不允许以模块的其它路径退出。结构 化编程语言在没有恢复堆栈和其它相关 的寄存器之前,不应随便跳入或跳出一 个模块
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