本章知识要点:  时序逻辑电路的基本概念;  同步时序逻辑电路的分析和设计方法;  典型同步时序逻辑电路的分析和设计。 5.1 概 述 5.2 同步时序逻辑电路分析 5.3 同步时序逻辑电路的设计 5.4 同步时序逻辑电路设计举例

实验一：集成逻辑门电路的测试与使用 实验二：组合逻辑电路的设计 实验三：时序逻辑电路的设计 实验四：脉冲信号的产生与变换 实验五：A/D 和 D/A 转换器及其应用 实验六：序列信号发生器的设计（设计性）

基本门电路的设计（采用数据流设计 ） 基本门电路表达简单逻辑关系，采用简单的赋值语句就能方 便地实现；没有必要采用更复杂的结构

实验一 Quartus II 集成开发环境及 EDA 开发流程 实验二 Verilog 基本逻辑电路设计 实验三 ModelSim 功能仿真 实验四 状态机控制串/并转换&数码静态显示电路设计 实验五 字符液晶显示器驱动控制电路设计

一． 4位加法计数器设计 二． 8位数码管显示扫描电路设计 三． 13分频器电路设计

前面我们的例题,就是采用小规模器件进行设计的 下面我们再举两个例题,进一步熟悉这种设计方法 例7-10设计二一十进制同步计数器(十进制值按 5121码规律设计)

11-1数字系统设计概述 11-2ASM图、MDS图以及ASM图至MDS图的转换 11-3数字密码引爆器系统设计 11-4数字系统设计实例

1 存储器分类及主要指标 2 常用存储器芯片介绍 3 扩展存储器设计 4 存储器地址译码电路设计 5 存储器与CPU的连接

一、 使用HDL设计的先进性 二、Verilog的主要用途 三、 Verilog的历史 四、如何从抽象级(levels of abstraction)理解 五、电路设计 六、Verilog描述 – 逻辑仿真算法 – 如何启动Verilog-XL和NC Verilog仿真器 – 如何显示波形 1. 进一步学习Verilog的结构描述和行为描述 2. Verilog混合（抽象）级仿真 1. 理解Verilog中使用的词汇约定 2. 认识语言专用标记(tokens) 3. 学习timescale

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