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文档格式:PDF 文档大小:1.23MB 文档页数:46
实验一 集成逻辑门电路 .3 实验二 数字集成电路接口实验 .7 实验三 加法器和译码显示电路 .10 实验四 触发器.15 实验五 数据选择器 .20 实验六 计数器.26 实验七 移位寄存器 .33 实验八 脉冲信号发生器 .38 实验九 555 定时器及应用 .40 实验十 增益自动切换的电压放大电路.44
文档格式:DOC 文档大小:796KB 文档页数:13
实验一 三人多数表决电路 实验二 用 74LS161 设计同步 12 进制计数器 实验三 用 VHDL 文本设计输入方法 实现组合逻辑电路 实验四 用 VHDL 文本设计输入方法 实现触发器 实验五 利用例化语句进行层次化设计 实验六 并行置位的移位寄存器 实验七 数字频率计设计 实验八 有限状态机设计——用状态机实现序列检测器的设计
文档格式:PDF 文档大小:4.79MB 文档页数:110
课题一、数制和码制 课题二、逻辑代数的公式和定理 课题三、逻辑函数的化简方法 课题四、具有无关项的逻辑函数及其化简 课题五、TTL反相器 课题六、小规模组合电路的分析 课题七、小规模组合电路的设计 课题八、编码器原理与应用 课题九、译码器原理与应用 课题十、数据选择器原理与应用 课题十一、加法器和数值比较器 课题十二、锁存器与电平触发的触发器 课题十三、脉冲触发的触发器 课题十四、边沿触发的触发器 课题十五、同步时序电路的分析 课题十六、移位寄存器的原理与应用 课题十七、计数器的原理与应用 课题十八、任意进制计数器的构成方法 课题十九、同步时序电路的设计 课题二十、CPLD和FPGA的结构与应用
文档格式:DOC 文档大小:23KB 文档页数:3
《数字电路与逻辑设计》课程实验指导(可编程逻辑实验)实验七 移位寄存器设计
文档格式:DOC 文档大小:415.88KB 文档页数:4
《数字电路与逻辑设计》课程实验指导(数字电路实验)实验八 移位寄存器及其应用
文档格式:DOC 文档大小:23KB 文档页数:3
《数字电路与逻辑设计》课程实验指导(可编程逻辑实验)实验七 移位寄存器设计
文档格式:PPT 文档大小:2.25MB 文档页数:23
《数字电子技术》课程教学课件(PPT讲稿)第五章 时序逻辑电路 CH53 寄存器和读写存储器
文档格式:PPTX 文档大小:116.08MB 文档页数:123
1. 双稳态触发器 2. 寄存器 3. 计数器 4. 时序逻辑电路的分析( 略) 5. 由555定时器组成的单稳态触发器和无稳态触发器
文档格式:PDF 文档大小:1.27MB 文档页数:81
微处理器的外部结构 微处理器的寄存器组织 微处理器的存储器组织和I/O组织 微处理器的内部结构 微处理器的功能结构
文档格式:PPT 文档大小:292KB 文档页数:36
• 代码生成要考虑的主要问题 • 基本块的代码生成(在一个基本块范围内考虑如何充分利用寄存器的问题) • 从dag生成代码
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