时序电路：含记忆元件、有反馈、输出与原来状态有关。 介绍基本记忆单元电路触发器，主要内容有电路结构、工作原理和逻辑功能。 介绍时序电路的基本概念、组成结构、逻辑功能，时序电路的分析方法与设计方法。 触发器 时序电路概述 同步时序电路的分析 同步时序电路的设计 异步时序电路

§21.1 双稳态触发器 §21.2 寄存器 §21.3 计数器 §21.5 555定时器及其应用 ※§21.6 应用举例 △§21.4 时序逻辑电路的分析

时序逻辑电路由组合电路和存储电路两部分构成。按触发脉冲输入方式的不同， 时序电路可分为同步时序电路和异步时序电路。同步时序电路是指各触发器状态的变化受同一个时钟脉冲控制；而在异步时序电路中，各触发器状态的变化不受同一个时钟脉冲控制

单稳态与无稳态电路 锁存器与触发器 时序电路分析 计数器与移位寄存器 双稳态元件

时序逻辑电路由组合电路和存储电路两部 分构成。 按触发脉冲输入方式的不同,时序电路可 分为同步时序电路和异步时序电路。同步 时序电路是指各触发器状态的变化受同一 个时钟脉冲控制;而在异步时序电路中, 各触发器状态的变化不受同一个时钟脉冲 控制

1. 掌握脉冲波形基本参数及参数间的关系； 2．了解TTL与非门原理，主要特性参数； 3．掌握555定时器原理、功能及应用； 4．掌握单稳态触发器的功能、分析方法及典型电路（由555、运放等组成的）；

1．什么是单稳态触发器 触发脉冲未到来时----稳态 触发脉冲到来时 ----暂稳态----经tW----稳态 输出为幅度、宽度固定的矩形脉冲

同步时序电路设计是其分析的逆过程,是根据对电路逻辑功能的要求设计出具体的时序 逻辑电路。 同步时序电路是由触发器和组合逻辑构成,其设计就是选择触发器和寻找组合电路, 并将二者有机连接构造出满足设计要求的时序逻辑电路的过程

6.5同步时序逻辑电路的设计 同步时序逻辑电路设计又称同步时序逻辑电路 综合,其基本指导思想是用尽可能少的触发器和门 电路来完成设计。 6.5.1同步时序电路设计的一般步骤 1.作原始状态图和状态表; 2.对原始状态表化简; 3.状态分配; 4.选定触发器;5.求出输出函数和激励函数表达式; 6.画出逻辑电路图

§1 简单电压比较器 §2 施密特触发器－迟滞比较器 §3 窗口比较器 §4 方波发生器