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安徽电气工程职业技术学院:《数字电子技术》课程教学资源(讲义)实验一 集成逻辑门电路逻辑功能的测试
文档格式:PPT 文档大小:488KB 文档页数:16
一、实验目的 1、熟悉数字逻辑实验箱的结构、基本功能和使用方法。 2、掌握各种TTL门电路的逻辑功能
电子科技大学:《VHDL语言与数字集成电路设计》数字逻辑1-1
文档格式:PPT 文档大小:212KB 文档页数:16
Chapter 1: Introduction From analog to digital Digital circuits and devices Design for IC The target of the text The arrangement of the text
电子科技大学:《VHDL语言与数字集成电路设计》VHDL作业安排
文档格式:DOC 文档大小:32.5KB 文档页数:3
VDL语言与数字集成电路设计 课程习题安排
电子科技大学:《VHDL语言与数字集成电路设计》数字逻辑3-1
文档格式:PPT 文档大小:390.5KB 文档页数:14
电子科技大学:《VHDL语言与数字集成电路设计》数字逻辑3-1
电子科技大学:《VHDL语言与数字集成电路设计》数字逻辑2-2
文档格式:PPT 文档大小:159KB 文档页数:12
Representations of signed numbers In binary systems, an n-bit string can represent 2n different numbers 01234567
电子科技大学:《VHDL语言与数字集成电路设计》数字逻辑2-1
文档格式:PPT 文档大小:216KB 文档页数:14
Chapter 2 Number systems and codes Positional number system representation and conversion Representations of negative numbers BCD codes and gray code
电子科技大学:《VHDL语言与数字集成电路设计》数字逻辑3-3
文档格式:PPT 文档大小:1.69MB 文档页数:16
How to make a better device Good performance faster and less power consumed Low cost more compact and use less area
电子科技大学:《VHDL语言与数字集成电路设计》数字逻辑3-2
文档格式:PPT 文档大小:356KB 文档页数:14
Electrical behavior of cmos Steady-state behavior when output is hold on 1 or 0 Dynamic behavior when output is changing
电子科技大学:《VHDL语言与数字集成电路设计》第一章 概述(张鹰)
文档格式:PPT 文档大小:399KB 文档页数:27
VHDL Very high speed integration circuits Hardware Description Language 一种集成电路的硬件描述语言; 用于进行数字集成电路的设计;
《模拟与数字电路实验》参考资料:元件和实验系统_数字电路FPGA实验_获取最新版ise webpack的方法
文档格式:PDF 文档大小:734.84KB 文档页数:5
《模拟与数字电路实验》参考资料:元件和实验系统_数字电路FPGA实验_获取最新版ise webpack的方法
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