清华大学：数字逻辑_组合逻辑电路

5.1 加法器 5.2 数值比较器 5.3 编码器 5.4 译码器 5.5 数据选择器 5.6 数据分配器

《可编程逻辑电路设计》课程PPT教学课件（讲稿）PLD设计的VHDL语言实现（概述及组合逻辑部分）

一、组合逻辑电路某一时刻的输出只取决于此时刻的输入。 二、时序逻辑电路某一时刻的稳定输出不仅取决于当时的输入，还取决于过去的输入(历史状态)。 三、因此记忆元件(Memory Devices)是时序逻辑电路的基本元件

前面说过,组合逻辑电路的输出只与 输入有关,时序逻辑电路的输出既与当前 的输入有关,又与以前的历史状态有关。 那么以前的状态在哪里保存? 存在触发器里面,触发器是逻辑电路的基 本记忆单元。 本章学习有关触发器的知识,主要是 基本触发器、D、R-S和J-K触发器

第一章 数制与码制 第二章 逻辑代数基础 第四章 组合逻辑电路 第五章 触发器(Flip — Flop) 第六章 时序逻辑电路 第七章 脉冲信号和变化 第八章 D/A和A/D变换 第九章 半导体存储器 第十章 可编程逻辑器件 第十二章 数字系统设计基础

第一章VHDL的程序结构和软件操作 1-1 VHDL程序的基本结构 1-2软件操作—Max+plusⅡ的操作 第二章 VHDL语言要素 第三章 VHDL顺序语句 第四章 VHDL并行语句 4.1 并行语句概述 4.2 并行信号赋值语句 4.3 进程语句（process） 4.4 元件例化语句 4.5 生成语句（for-generate） 第五章 组合逻辑电路的设计和分析 5.1 概述 5.2 编码器 5.3 译码器 5.4 简单数字显示系统 5.5 其它 第六章 时序逻辑电路的设计和分析 6.2 触发器 6.3 计数器 6.4 分频器 6.5 寄存器 6.1 概述

第1章数字电子技术基础 第2章组合逻辑电路 第3章时序逻辑电路 第4章脉冲信号的产生与整形 第5章数模和模数转换

一、逻辑代数基础 二、组合逻辑电路 三、常用集成时序逻辑器件及应用 四、脉冲波形的产生与变换 五、存储器和可编程逻辑器件 六、集成逻辑门 七、触发器 八、时序逻辑电路 九、用VHDL进行数字系统设计

第1章 逻辑代数基础 第3章 组合逻辑电路 第4章 触发器 第5章 时序逻辑电路 第2章 门电路 第6章 脉冲波形的产生和整形 第7章 大规模与超大规模集成电路