已知图 1 电路晶体管电流放大倍数 β=400，基区体电阻 rbb’=10Ω，要求： 1． 分析电路的静态工作点 2． 用示波器分析电路的动态，并求出 Au 3． 用波特图仪分析电路的下限截止频率 fL

4.1概述 时序电路的定义: 电路任何一时刻的输出值不仅与该时刻输入变量的取值有关,而且与输入变量的输入序列有关,即与输入变量的历史情况有关,我们称之为时序电路 例:电梯工作过程

一、判断下列说法是否正确 ，凡对的在括号内打“√”，否则打“×”。 （ 1）现 测得两个 共射放大 电路空载 时的电压 放大倍数 均为－ 100，将 它们连成两级放大电路，其电压放大倍数应为 10000。 ( ) （ 2）阻 容耦合多 级放大电 路各级的 Q 点相互 独 立 ，( )它 只 能 放 大 交流信号。 ( )

6.1时序电路概述 6.2同步时序逻辑电路的分析 6.3异步时序电路的分析方法 6.4同步时序电路的设计方法

5.1 电路的输出在前六个脉冲内的变化如图 K5.1 所示

6．1 鉴幅电路如图所示。其中 UDD = 4.8V

第三章多级放大电路 自测题 一、判断下列说法是否正确,凡对的在括号内打“√”,否则打 “×”。 (1)现测得两个共射放大电路空载时的电压放大倍数均为-100,将它们连成两级放大电路,其电压放大倍数应为1000。() (2)阻容耦合多级放大电路各级的Q点相互独立,()它只能放大交流信号。() (3)直接耦合多级放大电路各级的Q点相互影响,()它只能放大直流信号。()

• 1.MSI的应用 • 2.组合逻辑电路的分析方法 • 3.组合逻辑电路的设计方法 Sec3.1 概述 Sec3.2 组合逻辑电路的分析方法 Sec3.3 组合逻辑电路的设计方法 Sec.3.5 多路选择器 Sec3.6 译码器 Sec.3.7 组合逻辑电路的VHDL设计方法 • Sec3.7.1 VHDL设计语言 • Sec3.7.2 用VHDL设计全加器 • Sec3.7.3 VHDL多路选择器设计 • Sec3.7.4 VHDL设计译码器方法

4.1概述 4.3 若干常用组合逻辑电路 4.4 组合逻辑电路中的竞争-冒险现象 4.5 用multisim分析组合逻辑电路

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