第一章 VHDL的程序结构和软件操作 第二章 数据类型与数据对象的定义 第三章 并行赋值语句 第四章 顺序赋值语句 第五章 组合逻辑电路的设计 第六章 时序逻辑电路的设计 第七章 子程序、库和程序包 第八章 CPLD和FPGA的结构与工作原理 第九章 数字钟电路的设计

第一章 数字逻辑基础 第三章 组合逻辑电路 第四章 触发器 第五章 时序逻辑电路 第六章 数字系统 第七章 可编程逻辑器件 PLD Programmable Logic Device

这一章,介绍一种新的逻辑部件--触发器触发器的“新”在于它具有“记忆功 能,它是构成时序逻辑电路的基本单元。本章首先介绍基本RS触发器的组成原理、特点 和逻辑功能。然后引出能够防止“空翻”现象的主从触发器和边沿触发器。同时,较详细 地讨论RS触发器、JK触发器、D触发器T触发器、T触发器的逻辑功能及其描述方 法。最后,通过一个实例帮你进一步体会触发器的“记忆”功能

一、ABEL语言逻辑方程设计法 逻辑方程是ABEL源文件描述逻辑设计 的一种方法。它既可进行组合逻辑设计, 也可进行时序逻辑设计,但有时不如真值 表和状态图逻辑设计简单、易懂 但任何一种逻辑描述方式,经EDA软件 编译后,都会变成逻辑方程的形式

实验一：集成逻辑门电路的测试与使用 实验二：组合逻辑电路的设计 实验三：时序逻辑电路的设计 实验四：脉冲信号的产生与变换 实验五：A/D 和 D/A 转换器及其应用 实验六：序列信号发生器的设计（设计性）

第1章 逻辑代数基础 第3章 组合逻辑电路 第4章 触发器 第5章 时序逻辑电路 第2章 门电路 第6章 脉冲波形的产生和整形 第7章 大规模与超大规模集成电路

第一章 数制与码制 第二章 逻辑代数基础 第四章 组合逻辑电路 第五章 触发器(Flip — Flop) 第六章 时序逻辑电路 第七章 脉冲信号和变化 第八章 D/A和A/D变换 第九章 半导体存储器 第十章 可编程逻辑器件 第十二章 数字系统设计基础

6.2.1 计数器的特点和分类 6.2.2 二进制计数器 6.2.3 十进计数器（8421BCD码） 6.2.4 N进制计数器

6.5采用中规模集成器件设计任意进制计数器 6.6采用小规模集成器件设计计数器

6.5采用中规模集成器件设计任意进制计数器 6.6采用小规模集成器件设计计数器