一、理解什么是正向设计方法 二、 HDL在EDA设计中的作用 三、 VHDL的特点

7. VHDL代码中的时序逻辑和组合逻辑表达 8. 语句的执行时间问题 （顺序语句 & 并行语句） 9. 基本单元电路的VHDL代码 （三态门，双向缓冲器，计数器，D触发器，译码器……） 11. 复杂代码结构 (子程序; 元件; 块; 包) 12. 属性定义语句 13. 库的使用

一、属性：指设计实体、结构体、数据类型、信号等对象的特定特征。 二、VHDL的预定义属性分类： 1、数值类属性； 2、函数类属性； 3、信号类属性； 4、数据类型类属性； 5、数据区间类属性

5.1 4位加法计数器的VHDL描述 5.2不同工作方式的时序电路设计 5.3 数据对象DATA OBJECTS

实验一 三人多数表决电路 实验二 用 74LS161 设计同步 12 进制计数器 实验三 用 VHDL 文本设计输入方法 实现组合逻辑电路 实验四 用 VHDL 文本设计输入方法 实现触发器 实验五 利用例化语句进行层次化设计 实验六 并行置位的移位寄存器 实验七 数字频率计设计 实验八 有限状态机设计——用状态机实现序列检测器的设计

6.18位加法器的设计 1、设计思路 多位加法器的构成方式:并行进位 串行进位 并行进位:速度快、占用资源多 串行进位:速度慢、占用资源少

一、重载：指同样名称的子程序或运算符可以用不同的数据类型作为它们的输入参数而被定义多次；即当多个子程序或运算符具有同一名称的时候，该子程序或运算符就会被重载

14. 复杂代码设计要领 15. 层次化设计与元件语句（component ） 16. 代码复制（generate定义语句） 17. 复杂电路的代码结构

6.1 8位加法器的设计 6.2 8位乘法器的设计 6.3 序列检测器的设计 6.4 正负脉宽数控调制信号发生器的设计 6.5 数字频率计的设计 6.6 秒表的设计 6.7 MCS–51单片机与FPGA/CPLD总线接口逻辑设计 6.8 交通灯信号控制器的设计 6.9 语音信箱控制系统的设计 6.10 PID控制器的设计 6.11 空调系统有限状态自动机的设计 6.12 闹钟系统的设计

1. 什么是有限状态机？ 2. FSM的应用 3. 使用FSM设计电路有何好处？ 4. VHDL代码FSM的组成、分类 5. 单进程状态机 & 多进程状态机 6. Moore状态机 & Mealy状态机 7. 状态编码的选择 8. 状态机应用实例：SDRAM控制器