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重庆大学电气工程学院:《PLC各种通信方式的特点与选择》讲义(廖常初)
文档格式:PDF 文档大小:102.53KB 文档页数:4
以 OMRON 公司的 PLC 为例 , 介绍了 PLC 各种通信方式的特点、硬件接线和实现 数据交换的方法 , 最后介绍了选择通信方式时应考虑的一些问题
《MCS-51单片机原理及应用》PPT教学课件:第三章 MCS-51单片机指令系统及汇编语言程序设计
文档格式:PPT 文档大小:572KB 文档页数:103
3-1 汇编语言与指令系统简介 3-2 数据传送类指令 3-3 算术运算类指令 3-4 逻辑运算类指令 3-5 控制转移类指令 3-6 位操作类指令 3-7 汇编语言的汇编过
南京理工大学:《数字逻辑电路》课程PPT教学课件(脉冲和数字电路)第6章 存储器和可编程逻辑器件
文档格式:PPT 文档大小:1.25MB 文档页数:141
6.1 存储器 6.1.1 ROM (Read-Only Memory) 6.1.2 随机存取存储器 (RAM) 6.2 可编程逻辑器件(PLD) 6.2.1 可编程阵列逻辑(PAL) 6.2.2 通用阵列逻辑(GAL) 6.2.3 PLD的开发过程 6.3 VHDL语言 6.3.1 VHDL基本结构与语法 6.3.1.1 VHDL的组成 6.3.1.2 实体(Entity) 6.3.1.3 结构体 (Architecture) 6.3.1.4 程序包 (Package) 与 USE 语句 6.3.1.5 库 (Library) 6.3.1.6 VHDL运算符 6.3.1.7 数据对象 6.3.1.8 VHDL常用语句 6.3.1.9 元件及元件例化 6.3.1.10 配置 (configuration) 6.3.1.11 子程序 6.3.1.12 其他:属性、时钟的表示 6.3.1.13 VHDL的模板 6.3.1.14 常见错误 6.3.1.15 保留字
《信息论与编码基础》课程教学资源(教案讲义)第六章 差错控制
文档格式:DOC 文档大小:948.5KB 文档页数:15
差错控制:针对某一特定的数据传输或 存贮系统,应用纠错或检错的编码及其 相应的其他技术(如反馈重传)来提高 整个系统的传输可靠性的方法。 信道编码概念小结: 目的:降低错误译码概率 PE。 对象:信息序列(设码元间彼此无关且 等概出现)
《程控交换与宽带交换》课程电子教案(PPT教学课件)第7章 IP与ATM的融合
文档格式:PPT 文档大小:191.5KB 文档页数:47
ATM是一种信息复用和交换技术,由于它 只涉及OSI/RM的下两层,对每个数据包的处 理过程大大简化,处理时间大大缩短,并采用 定长单元(信元)进行发送,具有带宽宽 (622Mbit/s甚至到10Gbit/s)、吞吐容量大和 伸缩性强等特点,可为不同等级的业务提供相 应的服务质量(QoS)
电子科技大学:《电子设计自动化技术》课程教学资源(讲义课件)第八章 自定义数据类型
文档格式:PDF 文档大小:83.85KB 文档页数:7
VHDL 允许用户自行定义类型; 自定义类型的元素实际上全部来自预定义类型; 用户定义类型必须在使用以前进行类型说明; (在结构体、函数、过程、进程的说明部分进行说明) 最常用的用户定义类型形式为:
南京邮电大学:《数字电路与系统设计》课程教学资源(PPT课件讲稿)第六章 时序逻辑电路(3/7)
文档格式:PPT 文档大小:1.24MB 文档页数:44
一、寄存器 寄存器常用于寄存一组二值代码,它被广泛 地用于各类数字系统和数字计算机。 从广义上说寄存器也是一种存储器,但是 它又不同于第九章介绍的半导体存储器。 寄存器的特点: 存数方便,但容量小,一般只能存放一个 或几个字,通常用来暂存运算的中间结果,而 且一旦掉电,存放的数据即丢失
南京邮电大学:《数字电路与系统设计》课程教学资源(PPT课件讲稿)第六章 时序逻辑电路(3/5)
文档格式:PPT 文档大小:391.5KB 文档页数:10
1.寄存器特点:存数方便,容量小,一旦掉电,存放的数据即丢失。 2.寄存单元
西北工业大学:《数字电子技术基础》课程教学资源(PPT课件讲稿)第七章 时序逻辑电路(7.5)序列信号发生器
文档格式:PPT 文档大小:1.05MB 文档页数:15
什么是序列信号? 序列信号是把一组0、1数码按一定规则顺序排列的串行信 号,可以做同步信号、地址码、数据等,也可以做控制信号。 这一节非常重要,是中规模集成电路的综合运用
《Digital Signals Processing 数字信号处理》课程授课教案(PPT课件讲稿)第二章 C5000DSP硬件结构
文档格式:PPT 文档大小:697KB 文档页数:30
一、多总线结构,三组16-bit数据总线和一组程序总线 二、40-bit算术逻辑单元(ALU),包括一个40- bit的桶形 三、移位器和两个独立的40-bit加器 四、17x17-bit并行乘法器,连接一个40-bit的专用加法器
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