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电子科技大学:《VHDL语言与数字集成电路设计》第十六章 组合运算模块的ⅥHDL设计
文档格式:PPT 文档大小:296KB 文档页数:30
在硬件逻辑电路中,实际面对的数据对象总 是逻辑量,能够直接形成的运算是逻辑运算 算术运算可以看作是一种抽象的行为描述 组合运算电路主要包括加法器( adder)和 乘法器( multipliers)
电子科技大学:《VHDL语言与数字集成电路设计》第四章 数字集成电路的设计流程
文档格式:PPT 文档大小:452KB 文档页数:22
数字集成电路的设计流程 设计输入:以电路图或HDL语言的形式形成 电路文件;输入的文件经过编译后,可以 形成对电路逻辑模型的标准描述; 逻辑仿真(功能仿真):对如上形成的逻 辑描述加入输入测试信号,检查输出信号 是否满足设计要求;在此没有考虑任何时 间关系,只是检测逻辑是否有错;
电子科技大学:《VHDL语言与数字集成电路设计》第十七章 时序运算模块的ⅥHDL设计
文档格式:PPT 文档大小:181.5KB 文档页数:25
时序电路的结构与特 内部含有存储器件(触发器、锁存器); 信号变化受时钟控制; 通常采用状态变化进行描述; 采用进程进行设计;
《Verilog HDL语言》教程教学资料(参考书籍)第10章 其他论题
文档格式:PDF 文档大小:696.73KB 文档页数:27
本章讲述诸如函数、任务、层次结构、值变转储文件和编译程序指令等多种论题
电子设计自动化《EDA技术》专业选修课PPT讲义(2/3):硬件编程语言ABEL-HDL
文档格式:PPT 文档大小:115.5KB 文档页数:53
电子设计自动化《EDA技术》专业选修课PPT讲义(2/3):硬件编程语言ABEL-HDL
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