数字集成电路的设计流程 设计输入:以电路图或HDL语言的形式形成 电路文件;输入的文件经过编译后,可以 形成对电路逻辑模型的标准描述; 逻辑仿真(功能仿真):对如上形成的逻 辑描述加入输入测试信号,检查输出信号 是否满足设计要求;在此没有考虑任何时 间关系,只是检测逻辑是否有错;

数字集成电路的设计流程 设计输入:以电路图或HDL语言的形式形成 电路文件;输入的文件经过编译后,可以 形成对电路逻辑模型的标准描述; 逻辑仿真(功能仿真):对如上形成的逻 辑描述加入输入测试信号,检查输出信号 是否满足设计要求;在此没有考虑任何时 间关系,只是检测逻辑是否有错;

4.1 编码器 4.2 译码器 4.3 数据选择器 4.4 半加器与全加器 4.5 集成组合电路的扩展

6.1 概述 6.2 555定时器 6.3 555定时器的基本应用电路

6.1时序逻辑电路的分析与设计方法 6.2计数器 6.3寄存器 6.4顺序脉冲发生器

6.1 概述 6.2 时序逻辑电路的分析 6.3 时序逻辑电路的设计 6.4 常用时序逻辑电路

广东海洋大学：《数字电子技术》课程教学资源（授课计划）教案15 6．1 时序逻辑电路的特点和逻辑功能的描述 6．2 时序逻辑电路的分析方法

广东海洋大学：《数字电子技术》课程教学资源（授课计划）教案12 4．3 组合逻辑电路的设计方法 4．4 组合逻辑电路中的竞争-冒险现象 5．1 SR 锁存器

广东海洋大学：《数字电子技术》课程教学资源（授课计划）教案9 4．1 组合逻辑电路的特点和分析方法 4．2 常用的组合逻辑电路 4．2．2 编码器

第一节 寄存器 第二节 计数器 第三节 一般时序电路