VHDL中的行为设计:进程语句 以电路功能块为基础,直接考虑信 流程或状态变化过程 电路功能块采用进程表达,通过信号 进行功能块之间的交流;

在硬件逻辑电路中,实际面对的数据对象总 是逻辑量,能够直接形成的运算是逻辑运算 算术运算可以看作是一种抽象的行为描述 组合运算电路主要包括加法器( adder)和 乘法器( multipliers)

本章简要地阐述最主要的数学知识及计算机中最基本的单元电路。本章的内容是必要的入门知识，是以后各章的基础。对于已掌握这些知识的读者，本章将起到复习和系统化的作用。 2.1 数制与编码 2.2 单片机系统常用数字集成电路 2.3 单片机系统中的常用存储器电路

❑ 1.1 Introduction ❑ 1.2 Overview on Manufacturing Process ❑ 1.3 The MOS(FET) Transistor ❑ 1.3.1 I-V/C-V characteristics (self-learning) ❑ 1.3.2 SPICE Models ❑ 1.4 Process Variations

时序电路的结构与特 内部含有存储器件(触发器、锁存器); 信号变化受时钟控制; 通常采用状态变化进行描述; 采用进程进行设计;

Library库 编译后数据的集合,存放包集合定义、实体定 义、构造体定义和配置定义,其功能相当于其 他操作系统中的目录,经过说明后,设计中就 可以使用库中的数据,实现共享;

第六章 Verilog的数据类型及逻辑系统 • 学习Verilog逻辑值系统 • 学习Verilog中不同类的数据类型 • 理解每种数据类型的用途及用法 • 数据类型说明的语法 第7章 结构描述(structural modeling) • 如何使用Verilog的基本单元(primitives) • 如何构造层次化设计 • 了解Verilog的逻辑强度系统 第8章 延时模型 学习内容： 1. 如何说明块延时 2. 如何说明分布延时 3. 如何说明路径延时 4. 怎样在模块中说明时序检查 5. 标准延时格式SDF（Standard Delay Format) 第九章 编译控制的使用 • 开发商提供的Verilog库 • 用Verilog库仿真 • Verilog源代码加密 • 其它仿真器相关的问题

北京大学：《集成电路原理与设计 Principle of Integrated Circuits》课程电子教案（数字集成电路原理与设计）chap5-3 第5章 数字集成电路基本模块 5.3 时序单元电路

北京大学：《集成电路原理与设计 Principle of Integrated Circuits》课程电子教案（数字集成电路原理与设计）chap5-2 第五章 数字集成电路基本模块 5.2 加法器

北京大学：《集成电路原理与设计 Principle of Integrated Circuits》课程电子教案（数字集成电路原理与设计）chap5-4 第五章 数字集成电路中的基本模块 5.4 时序模块电路