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根据逻辑条件的判断构成程序分支结构 if 布尔表达式 then 顺序语句 end if; 当布尔表达式为 true 时, 执行 then 后面的顺序语句;
文档格式:PDF 文档大小:2.34MB 文档页数:36
TEXTIO是文本输入输出包集合,该 包中含有对文本文件进行读写的过 程和函数。 输入输出的文本文件均为ASCII码 文件。 TEXTIO按行对文件处理,以回车、 换行符作为行结束
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在赋值类语句中,经常引用函数来表达常用的运算; function 的结构主要由参量表、说明部分和顺序执行部分构 成,具体结构形式如下 P.276 表 4-35: function function-name ( signal-list) return return-type is declarations and definitions;
文档格式:PDF 文档大小:494.47KB 文档页数:21
一、对VHDL程序的宏观结构有一个明确的概念性认识; 二、认识实体、构造体的基本格式 三、理解实体、构造体在VHDL程序中的基本功能 四、能够尝试编写简单的VHDL程序
文档格式:PDF 文档大小:116.31KB 文档页数:6
Very high speed integration circuits HDL 起源: 1985 年,美国国防部提出计划; 1987 年成为 IEEE1076 标准; 1993 年进一步修订完善; 是目前标准化程度最高,适应性最广的 HDL 语言; 特点:
文档格式:PDF 文档大小:101.21KB 文档页数:12
具体描述电路各元件的端口及其连接; 以基本元件为基础逐级构建; 元件:已经定义的电路模块(实体),可以来自标准库中,也 可以是自己或他人以前编译过的实体; 元件的基本要点: 元件名 输入/输出端口特点;
文档格式:DOC 文档大小:2.52MB 文档页数:27
4.1概述 时序电路的定义: 电路任何一时刻的输出值不仅与该时刻输入变量的取值有关,而且与输入变量的输入序列有关,即与输入变量的历史情况有关,我们称之为时序电路 例:电梯工作过程
文档格式:DOC 文档大小:75.5KB 文档页数:10
用状态表的方法设计大型复杂的数字系统 (有时甚至是简单的数字逻辑问题)是十分困难的,甚至是不可能的。原因是状态数大的惊人
文档格式:PPT 文档大小:964KB 文档页数:122
一、传统的硬件设计方法 二、传统的设计方法是自下而上的设计方法 三、采用通用的元器件 四、后期进行仿真,浪费大,设计周期长 五、主要设计文件是电路原理图,可读性差,文件量大
文档格式:PPT 文档大小:980KB 文档页数:179
3.1 原理图设计工具 3.2 原理图元件、元件库及元件库的使用 3.3 实体放置与编辑 3.4 层次电路设计 3.5 一个完整的电路实例 3.6 报表 3.7 原理图输出
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