实验一 三人多数表决电路 实验二 用 74LS161 设计同步 12 进制计数器 实验三 用 VHDL 文本设计输入方法 实现组合逻辑电路 实验四 用 VHDL 文本设计输入方法 实现触发器 实验五 利用例化语句进行层次化设计 实验六 并行置位的移位寄存器 实验七 数字频率计设计 实验八 有限状态机设计——用状态机实现序列检测器的设计

▪ 2.1 总体概况 ▪ 2.2 微处理器 ▪ 2.3 存储器 ▪ 2.4 并行输入/输出接口 ▪ 2.5 定时/计数器 ▪ 2.6 串行输入/输出接口 ▪ 2.7 中断系统 ▪ 2.8 特殊工作方式

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