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江西农业大学:《数字逻辑》课程教学资源(PPT讲稿)第六章 时序逻辑电路——6.3 计数器 6.3.1 二进制同步加计数器
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6.1 基本RS触发器 6.2 同步触发器 6.3 主从触发器 6.4 边沿触发器 6.5 不同类型触发器间的转换
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6.1 时序电路的分析 6.2 同步时序电路的设计 6.3 计数器 6.4 寄存器与移位寄存器
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第一节 概述 第二节 基本RS触发器 第三节 同步触发器
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6.4 计数器 6.4.1 异步计数器 6.4.2 同步计数器
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一、调速方法概述 二、节流阀 三、采用节流阀的节流调速回路 四、节流调速的速度稳定 五、其它流量阀 六、同步回路
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§4.1 数字调制的基本原理 §4.2 数字调制方式及调制信号频谱特性 §4.3 数字信号的接收 §4.4 载波同步
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9.1串行通信 9.280C51的通用同步/异步收/发器USART模块
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数据通信基本概念 数据通信系统基本结构 信息、数据、信号 数据通信的主要技术指标 数据传输方式 串行通信、并行通信 单工通信、半双工通信、全双工通信 基带传输、频带传输、宽带传输 数据的同步技术 异步传输、同步传输 数据编码技术 数字数据信号 模拟传输 幅移键控ASK、频移键控FSK、 相移键控PSK 数字传输 不归零码NRZ、曼彻斯特编码、 差分曼彻斯特编码 模拟数据信号 模拟传输 调幅、调频、调相 数字传输 脉冲编码调制PCM 多路复用技术 时分多路复用、频分多路复用、波分多路复、码分多路复用 数据交换技术 电路交换、报文存储转发交换、报文分组存储转发交换(数据 报方式、虚电路方式) 传输介质 传输介质类型与特点 差错控制技术 检错码、纠错码和差错控制机制
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基本原则之一:面积和速度的平衡与互换; 基本原则之二:硬件原则; 基本原则之三:系统原则; 基本原则之四:同步设计原则; 基本设计思想与技巧之一:乒乓操作; 基本设计思想与技巧之二:串并转换; 基本设计思想与技巧之三:流水线操作; 基本设计思想与技巧之四:数据接口的同步方法; 常用模块之一:RAM; 常用模块之二:全局时钟资源与时钟锁相环; 常用模块之三:全局复位/置位信号; 常用模块之四:高速串行收发器。 HDL语言的层次含义; ·Coding Style的含义; ·结构层次化编码; ·模块的划分的技巧; 比较判断语句case和if...else的优先级; 慎用锁存器(Latch); ·使用Pipelining方法优化时序; 模块复用与Resource Sharing; 逻辑复制; 香农扩展; 信号敏感表; 复位逻辑; FSM设计的一般型原则; 用Verilog语言设计FSM的技巧; ·CPLD原理与设计方法
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