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南京邮电大学:《数字电路与系统设计》课程教学资源(PPT课件讲稿)第四章 习题课
文档格式:PPT 文档大小:1.14MB 文档页数:30
例一:下图电路中74157是四位二选一,其输 出端的逻辑表达式为Y=E(A D0+AD1 ),7485是 四位数字比较器
南京邮电大学:《数字电路与系统设计》课程教学资源(PPT课件讲稿)第三章 集成逻辑门电路(2/3)
文档格式:PPT 文档大小:657KB 文档页数:38
1. 54H/74H系列 图3.2.13 54H/74H系列与非门(54H/74H00)的电路结构
《数字电路设计》课程教学资源(PPT课件讲稿)第7章 常用集成时序逻辑器件及应用
文档格式:PPT 文档大小:2.8MB 文档页数:121
7.1 集成计数器 7.2 集成寄存器和移位寄存器 7.3 序列信号发生器 7.4 以MSI为核心的同步时序电路的分析与设计
《数字电路》课程电子教案(PPT课件讲稿)第六章 时序逻辑电路(2/5)
文档格式:PPT 文档大小:922KB 文档页数:20
同步计数器由若干个触发器组成,触发器的时钟端 都连在一起,触发器输出是同步更新的,因此称为同步 计数器。 由多个触发器的输出构成二进制计数值的各位,其 变化符合计数规律,加1或减1
《数字电路》课程电子教案(PPT课件讲稿)第六章 时序逻辑电路(3/5)
文档格式:PPT 文档大小:878KB 文档页数:20
前面我们的例题,就是采用小规模器件进行设计的 下面我们再举两个例题,进一步熟悉这种设计方法 例7-10设计二一十进制同步计数器(十进制值按 5121码规律设计)
《数字电路》课程电子教案(PPT课件讲稿)第六章 时序逻辑电路(4/5)
文档格式:PPT 文档大小:311KB 文档页数:11
我们在这里要解决的问题是: 如何用一个中规模N进制的计数器,实现一个M进 制的计数器(N>M)? 实际上就是一个多余的状态如何取掉的问题。以前 我们曾经讲过一些,有两种方法:清除法和置位法
《数字电路》课程电子教案(PPT课件讲稿)第三章 集成逻辑门(5/5)
文档格式:PPT 文档大小:600KB 文档页数:20
(一)、CMOS反相器工作原理 CMOS电路的结构特点是: 一个N沟道管和一个P沟道管配 G 对使用,即N、P互补(Comp- T lementary)
《数字电路》课程电子教案(PPT课件讲稿)第三章 集成逻辑门(4/5)
文档格式:PPT 文档大小:459KB 文档页数:15
ECL门的优点是速度快,因为它不用饱和态。 另一优点是工作电流平稳,没有动态尖峰。ECL门的缺点是高、低电平太接近(约0.8V) 抗干扰能力差。另一个缺点是功耗较大
南京邮电大学:《数字电路与系统》课程教学资源(PPT课件讲稿)第六章 时序逻辑电路(6.3)复杂时序电路的设计
文档格式:PPT 文档大小:1.58MB 文档页数:68
一、同步时序电路的设计 1.设计步骤 (1)建立原始状态表和状态图 原始的含义:是指没有经过简化而获得的状态 转移表和状态转移图。 对于原始状态表和状态图的要求是: 保证其绝对的正确性,确保状态无遗漏, 状态转移关系的正确
南京邮电大学:《数字电路与系统》课程教学资源(PPT课件讲稿)第六章 时序逻辑电路(6.5)置最小数法总结
文档格式:PPT 文档大小:1.37MB 文档页数:66
利用LD端的置最小数法实现任意 进制计数器,若实现模长为M,则 预置的最小数为2 n -M。将Qcc取反 送给LD即可
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