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广东海洋大学：《VHDL程序设计语言》课程教学资源（实验指导）实验七 Finite State Machines

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广东海洋大学：《VHDL程序设计语言》课程教学资源（实验指导）实验六 Adders, Subtractors, and Multipliers

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广东海洋大学：《VHDL程序设计语言》课程教学资源（实验指导）实验五 Clocks and Timers

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广东海洋大学：《VHDL程序设计语言》课程教学资源（实验指导）实验四 Counters

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广东海洋大学：《VHDL程序设计语言》课程教学资源（实验指导）实验三 Latches, Flip-flops, and Registers

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广东海洋大学：《VHDL程序设计语言》课程教学资源（实验指导）实验二 Numbers and Displays

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广东海洋大学：《VHDL程序设计语言》课程教学资源（实验指导）实验一 Switches, Lights, and Multiplexers

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• 带记录和子定型的简单类型化λ演算 • 等式理论和语义模型 • 递归类型的子定型和递归记录作为对象的模型

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程序设计语言_习题

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-λ表示法和λ演算系统概述 -类型和类型系统的扼要讨论 -基于表达式的归纳、基于证明的归纳和良基归纳