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3.1逻辑代数 3.2逻辑函数的卡诺图化简法 3.3组合逻辑电路的分析 3.4组合逻辑电路的设计 3.5组合逻辑电路中的竞争冒险
文档格式:PPT 文档大小:868.5KB 文档页数:47
3.1逻辑代数 3.2逻辑函数的卡诺图化简法 3.3组合逻辑电路的分析方法 3.4组合逻辑电路的设计方法 3.5组合逻辑电路中的竞争冒险
文档格式:PPT 文档大小:1.41MB 文档页数:102
3.1 由基本逻辑门构成的组合电路的分析和设计 3.1.1 组合电路的一般分析方法 3.1.2 组合电路的一般设计方法 3.2 MSI构成的组合逻辑电路 3.2.1 自顶向下的模块化设计方法 3.2.2 编码器 3.2.3 译码器 3.2.4 数据选择器 3.2.5 数据分配器 3.2.6 算术运算电路 3.2.7 数值比较器 3.3 组合电路设计举例: 算术逻辑单元(ALU) 3.4 组合逻辑电路中的冒险 3.4.1 产生冒险的原因 3.4.2 消去冒险的方法
文档格式:DOC 文档大小:34KB 文档页数:2
广东海洋大学:《数字电子技术》课程教学资源(授课计划)教案19 6.4 同步时序逻辑电路的设计方法 6.5 时序逻辑电路中的竞争-冒险现象
文档格式:DOC 文档大小:32KB 文档页数:2
广东海洋大学:《数字电子技术》课程教学资源(授课计划)教案12 4.3 组合逻辑电路的设计方法 4.4 组合逻辑电路中的竞争-冒险现象 5.1 SR 锁存器
文档格式:PPT 文档大小:757KB 文档页数:29
6.3同步时序逻辑电路的设计 注:只要求用门电路和触发器设计同步时序逻辑电路 6.3.1一般设计步骤(分析的逆过程) 1、画出原始状态图确定电路的输入、输出变量,以及电路应当包括的状态个数,状态转换 2、状态图化简合并等价状态等价状态:输入相同的情况下→输出相同、次态也相同
文档格式:PPT 文档大小:192.5KB 文档页数:17
5.4 时序电路的设计方法 5.4.1 时序电路的设计方法
文档格式:PPTX 文档大小:2.65MB 文档页数:26
6.3.1 设计同步时序逻辑电路的一般步骤 6.3.2 同步时序逻辑电路设计举例
文档格式:PPTX 文档大小:1.32MB 文档页数:50
6.5.1 寄存器和移位寄存器 6.5.2 计数器
文档格式:PPTX 文档大小:269.38KB 文档页数:9
《数字电子技术》课程PPT教学课件课件(电类)第06章 时序逻辑电路的分析与设计 6.4 异步时序逻辑电路的分析
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