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14.1 触发器 R-S触发器 D触发器 14.2 寄存器

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1.PROM和PAL的结构是 A.PROM的与阵列固定,不可编程B.POM与阵列、或阵列均不可编程 C.PAL与阵列、或阵列均可编程D.PAL的与阵列可编程 2.当用专用输出结构的PAL设计时序逻辑电路时,必须还要具备有 A.触发器B.晶体管C.MOS管D.电容

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1.以下表达式中符合逻辑运算法则的是 B.1+1=10 C.0<1 D.A+1 2.逻辑变量的取值1和0可以表示 A.开关的闭合、断开B.电位的高、低C.真与假D.电流的有、无

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一,学时:2学时二.目的要求: 1.掌握基本门电路的分析 2.掌握组合逻辑电路的分析

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3.1.2基本RS触发器 (1)逻辑电路及逻辑符号 (2)RS触发器的特征表

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绪论数字逻辑电路 1数字信号 (1)数字量:在时间和幅度上不连续变化的物理量。它们的变化总是发生在一系列离散的瞬间

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第一节寄存器第二节计数器第三节一般时序电路

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第7章数据流模型化本章讲述 Verilog HDL语言中连续赋值的特征。连续赋值用于数据流行为建模:相反,过程赋值用于(下章的主题)顺序行为建模。组合逻辑电路的行为最好使用连续赋值语句建模

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3.1 概述 3.2 VHDL程序基本结构 3.3 VHDL语言要素 3.4 VHDL顺序语句 3.5 VHDL并行语句 3.6 子程序(SUBPROGRAM) 3.7 库、程序包及其他 3.8 VHDL描述风格 3.9 基本逻辑电路设计 3.10 状态机的VHDL设计

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1.4 逻辑代数的基本定理 1.5 逻辑函数及其表示方法 1.6（1.7）逻辑函数的卡诺图化简法 1.7（1.8）具有无关项逻辑函数及其化简