4.1组合逻辑电路的分析 4.2组合逻辑电路的设计 4.3组合逻辑电路中的竞争和冒险 4.4常用组合逻辑集成电路 4.5组合可编程电路 4.6用Verilog HDL描述组合逻辑电路

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第三章组合逻辑电路的分析与设计 3、1逻辑代数 一、逻辑代数的基本公式

单稳态与无稳态电路 锁存器与触发器 时序电路分析 计数器与移位寄存器 双稳态元件

一、组合逻辑电路某一时刻的输出只取决于此时刻的输入。 二、时序逻辑电路某一时刻的稳定输出不仅取决于当时的输入，还取决于过去的输入(历史状态)。 三、因此记忆元件(Memory Devices)是时序逻辑电路的基本元件

6.5同步时序逻辑电路的设计 同步时序逻辑电路设计又称同步时序逻辑电路 综合,其基本指导思想是用尽可能少的触发器和门 电路来完成设计。 6.5.1同步时序电路设计的一般步骤 1.作原始状态图和状态表; 2.对原始状态表化简; 3.状态分配; 4.选定触发器;5.求出输出函数和激励函数表达式; 6.画出逻辑电路图

6.1 二进制并行加法器 6.2 数值比较电路 6.3 译码器 6.4 多路选择器 6.5 计数器 6.6 寄存器 6.7 只读存储器 6.8 可编程逻辑阵列

1.原理：在控制信号作用下，从多个输入中每次选中一个输出。因此又称多路开关(Multiplexer－MUX)。是计算机系统中使用最多的一类中规模器件

1掌握同步时序电路的一般分析方法 2掌握同步计数器的一般分析方法 3会用反馈归零法、反馈置数法和级联法将集成芯片构成任意进制计数器 4根据功能表会用大、中规模集成芯片构成给定功能的电路  第1、2学时： 时序逻辑电路的分析方法  第3、4学时： 时序逻辑电路的设计方法  第5、6学时： 同步计数器  第7、8学时： 集成同步计数器及其应用  第9、10学时：数据寄存器和移位寄存器

实验一 门电路逻辑功能及测试 实验二 组合逻辑电路 实验三 译码器和数据选择器 实验四 触发器 实验五 时序电路测试及研究 实验六 计数译码显示电路的设计 实验七 555时基电路的应用 实验八 数字电子秒表