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电子科技大学:《数字系统EDA技术》第四章 MAX+PLUS工开发工具
文档格式:PPT 文档大小:980.5KB 文档页数:45
4.1概述 MAX+PLUS Multiple Array Matrix and Programmable Logic User System A+PLUSⅡ的特点: 1.与结构无关 2.多平台 3.完全集成化
电子科技大学:《数字系统EDA技术》第三章(3-9) 基本逻辑电路设计
文档格式:PPT 文档大小:2.11MB 文档页数:65
一、基本逻辑电路: 二、组合逻辑电路、 三、时序逻辑电路
清华大学:《逻辑设计与数字系统》课程教学资源(PPT课件)第四章 时序逻辑电路(4-1)
文档格式:PPT 文档大小:606.5KB 文档页数:40
4.1概述 4.1.1时序逻辑电路的分类 4.1.2时序逻辑电路的分析 4.2常见的时序逻辑电路
清华大学:《逻辑设计与数字系统》课程教学资源(PPT课件)边沿触发器的电路结构、动作特点(3-2)
文档格式:PPT 文档大小:385.5KB 文档页数:15
一、提高触发器的工作可靠性, 二、增强抗干扰能力
清华大学:《逻辑设计与数字系统》课程教学资源(PPT课件)算术逻辑单元图2.2774181型算术逻辑单元逻辑图
文档格式:PPT 文档大小:186.5KB 文档页数:4
清华大学:《逻辑设计与数字系统》课程教学资源(PPT课件)算术逻辑单元图2.2774181型算术逻辑单元逻辑图
清华大学:《逻辑设计与数字系统》课程教学资源(PPT课件)减法电路
文档格式:PPT 文档大小:147KB 文档页数:8
清华大学:《逻辑设计与数字系统》课程教学资源(PPT课件)减法电路
数控系统的电磁兼容设计
文档格式:PDF 文档大小:165.72KB 文档页数:29
数控系统的电磁兼容设计
清华大学:《逻辑设计与数字系统》课程教学资源(PPT课件)组合逻辑电路的竞争和冒险
文档格式:PPT 文档大小:204KB 文档页数:6
竞争的结果若导致冒险(险象)发生(如上例中的毛刺),并造成 错误的后果,则称这种竞争为临界竞争;竞争的结果不导致冒险发 生(如上例中的t1,t3时刻,没有毛刺),或虽有冒险发生,但不影 响系统的工作,则称这种竞争为非临界竞争
电子科技大学:《电子设计自动化技术》课程教学资源(讲义课件)数字集成电路的发展
文档格式:PDF 文档大小:312.78KB 文档页数:8
数字集成电路的发展 自 20 世纪 60 年代以来遵循摩尔定律,每 1.5 年集成度与速度提高一倍。 从简单的门电路到复杂的数字系统,系统复杂程度急剧提高
电子科技大学:《数字系统EDA技术》第六章 VHDL设计应用实例
文档格式:PPT 文档大小:1.48MB 文档页数:40
6.18位加法器的设计 1、设计思路 多位加法器的构成方式:并行进位 串行进位 并行进位:速度快、占用资源多 串行进位:速度慢、占用资源少
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