4.1 组合逻辑电路的分析 4.2 组合逻辑电路的设计 4.3 常用MSI组合逻辑器件及应用 4.4 组合逻辑电路中的竞争与冒险

异步时序逻辑电路的特点及模型 1.同步时序逻辑电路的特点 各触发器的时钟端全部连接在一起,并接在系统时钟端;只有当时钟脉冲到来时,电路的状态才能改变;改变后的状态将一直保持到下一个时钟脉冲的到来,此时无论外部输入x有无变化;状态表中的每个状态都是稳定的

设计方法与同步时序逻辑电路相似，但如果触发器有时钟控制端的话应将其作为激励来考虑，并注意脉冲异步时序电路对输入脉冲的两个限制条件

5.1 概述 5.2 时序逻辑电路的分析方法 5.3 若干常用时序逻辑电路 5.3.1 寄存器和移位寄存器

6.5.5同步时序逻辑电路设计举例 例: 设计一个“11.序列检测器,用来检测串行二进制序列,要求每当连续输入3个(或3个以上)1时,检测器输出为1,否则输出为0。其典型输入输出序列如下: 输入x:0111011110 输出Z:0001000110

3.3 常用组合逻辑电路 编码器 译码器 数据选择器 比较器 加法器 函数发生器

6.1 存储器 6.1.1 ROM (Read-Only Memory) 6.1.2 随机存取存储器 (RAM) 6.2 可编程逻辑器件（PLD) 6.2.1 可编程阵列逻辑(PAL) 6.2.2 通用阵列逻辑(GAL) 6.2.3 PLD的开发过程 6.3 VHDL语言 6.3.1 VHDL基本结构与语法 6.3.1.1 VHDL的组成 6.3.1.2 实体（Entity) 6.3.1.3 结构体 (Architecture) 6.3.1.4 程序包 (Package) 与 USE 语句 6.3.1.5 库 (Library) 6.3.1.6 VHDL运算符 6.3.1.7 数据对象 6.3.1.8 VHDL常用语句 6.3.1.9 元件及元件例化 6.3.1.10 配置 (configuration) 6.3.1.11 子程序 6.3.1.12 其他：属性、时钟的表示 6.3.1.13 VHDL的模板 6.3.1.14 常见错误 6.3.1.15 保留字

一、半导体与数字集成电路： 1、1947年晶体管发明引起了电子学的一次革命，晶体管是约翰·巴丁、沃尔特·布雷登和威廉·肖克莱共同发明，该发明促成了计算机、通信等方面的飞速发展。鉴于它的重要价值，这些人共同获得了1956年的诺贝尔物理学奖

7.1 555集成定时器 7.1.1 5G555定时器的电路结构 7.1.2 定时器的逻辑功能 7.2 施密特触发器 7.2.1 用555定时器构成施密特触发器 7.2.2 集成施密特触发器 7.2.3 施密特触发器的应用 7.3 单稳态触发器 7.3.1 由555定时器构成的单稳态触发器 7.3.2 用施密特触发器构成单稳态触发器 7.3.3 集成单稳态触发器 7.3.4 单稳态触发器的应用 7.4 多谐振荡器 7.4.1 用555定时器构成多谐振荡器 7.4.2 用施密特触发器构成多谐振荡器 7.4.3 石英晶体多谐振荡器

一、数字电路的特点 二、典型应用 三、电子器件的发展 四、设计方法的变化 五、学习方法 六、考核方法 七、参考书 八、任课教师