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一、常见表达式：二、标准表达式：

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(1)三态输出与非门组成及工作原理

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10.8 现场可编程门阵列 FPGA:Field Programmable Gate Array 10.9 在系统可编程器件 ISP-PLD:In System Programmability PLD

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5.1 基本触发器的逻辑符号与输入波形如图P5.1所示。试作出 Q、Q 的波形

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设计方法与同步时序逻辑电路相似，但如果触发器有时钟控制端的话应将其作为激励来考虑，并注意脉冲异步时序电路对输入脉冲的两个限制条件

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6.1时序电路概述 6.2同步时序逻辑电路的分析 6.3异步时序电路的分析方法 6.4同步时序电路的设计方法

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4.1 组合逻辑电路的特点 4.2 组合逻辑函数的分析与设计 4.3 编码器 4.4 译码器 4.5 多路选择器 4.6 二进制并行加法器 4.7 数值比较器 4.8 奇偶校验器 4.9 利用中规模集成电路进行组合电路设计 4.10 组合电路的险象

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北京大学：《数字逻辑电路 Digital Circuits》课程授课电子教案_第五章时序电路分析与设计（二）同步时序电路设计实践

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北京大学：《数字逻辑电路 Digital Circuits》课程授课电子教案_第五章时序电路分析与设计（三）异步时序电路分析与设计

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11-1数字系统设计概述 11-2ASM图、MDS图以及ASM图至MDS图的转换 11-3数字密码引爆器系统设计 11-4数字系统设计实例