基本原则之一：面积和速度的平衡与互换； 基本原则之二：硬件原则； 基本原则之三：系统原则； 基本原则之四：同步设计原则； 基本设计思想与技巧之一：乒乓操作； 基本设计思想与技巧之二：串并转换； 基本设计思想与技巧之三：流水线操作； 基本设计思想与技巧之四：数据接口的同步方法； 常用模块之一：RAM; 常用模块之二：全局时钟资源与时钟锁相环； 常用模块之三：全局复位/置位信号； 常用模块之四：高速串行收发器。 HDL语言的层次含义； ·Coding Style的含义； ·结构层次化编码； ·模块的划分的技巧； 比较判断语句case和if...else的优先级； 慎用锁存器(Latch); ·使用Pipelining方法优化时序； 模块复用与Resource Sharing; 逻辑复制； 香农扩展； 信号敏感表； 复位逻辑； FSM设计的一般型原则； 用Verilog语言设计FSM的技巧； ·CPLD原理与设计方法

4.1 等效传输线 4.2 单口网络 4.3 双端口网络的阻抗与转移矩阵 4.4 散射矩阵与传输矩阵 4.5 多端口网络的散射矩阵

1.1 均匀传输线方程及其解 1.2 传输线的阻抗与状态参量 1.3 无耗传输线的状态分析 1.4 传输线的传输功率、 效率与损耗 1.5 阻抗匹配 1.6 同轴线的特性阻抗

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