网站首页
校园空间
教师库
在线阅读
知识问答
大学课件
高等教育资讯网
大学课件分类
:
基础课件
工程课件
经管课件
农业课件
医药课件
人文课件
其他课件
课件(包)
文库资源
点击切换搜索课件
文库搜索结果(2813)
电子科技大学:《VHDL语言与数字集成电路设计》第五章 数字集成电路的设计流程
文档格式:PPT 文档大小:481.5KB 文档页数:30
数字集成电路的设计流程 设计输入:以电路图或HDL语言的形式形成 电路文件;输入的文件经过编译后,可以 形成对电路逻辑模型的标准描述; 逻辑仿真(功能仿真):对如上形成的逻 辑描述加入输入测试信号,检查输出信号 是否满足设计要求;在此没有考虑任何时 间关系,只是检测逻辑是否有错;
电子科技大学:《VHDL语言与数字集成电路设计》第十五章 数字电路模块的VHDL设计
文档格式:PPT 文档大小:419KB 文档页数:25
数字电路模块的VHDL设计 一、组合模块的设计 二、时序模块的设计 三、存储模块的设计
电子科技大学:《VHDL语言与数字集成电路设计》第十九章 存储器模块的VHDL设计
文档格式:PPT 文档大小:149KB 文档页数:31
存储器模块的VHDL设计 一、典型的存储器模块有: 寻址存储器: ROM RAM 顺序存储器: FiFo Stack(LIFO
电子科技大学:《VHDL语言与数字集成电路设计》第四章 数字集成电路的设计流程
文档格式:PPT 文档大小:452KB 文档页数:22
数字集成电路的设计流程 设计输入:以电路图或HDL语言的形式形成 电路文件;输入的文件经过编译后,可以 形成对电路逻辑模型的标准描述; 逻辑仿真(功能仿真):对如上形成的逻 辑描述加入输入测试信号,检查输出信号 是否满足设计要求;在此没有考虑任何时 间关系,只是检测逻辑是否有错;
电子科技大学:《VHDL语言与数字集成电路设计》第三章 数字集成电路的设计形式
文档格式:PPT 文档大小:1.47MB 文档页数:30
数字集成电路的设计形式 全定制设计(ASIC或基于标准单元的设计(CBIC) 半定制设计或基于门阵列的设计(GA) 基于可编程器件(PLD)的设计;
电子科技大学:《VHDL语言与数字集成电路设计》第二十章 VHDL 与 Verilog HDL 的对比
文档格式:PPT 文档大小:280KB 文档页数:30
VHDL与 Verilog HDL的对比 1.整体结构 VHDL Verilog HDL entity实体名 is module模块名(端口表ort(端口说明)输入/输出端口说明
电子科技大学:《VHDL语言与数字集成电路设计》第十八章 有限状态机FSM的设计
文档格式:PPT 文档大小:493.5KB 文档页数:55
有限状态机FSM的设计 一、时序电路的结构与特点
电子科技大学:《VHDL语言与数字集成电路设计》第十三章 VHDL中的子结构
文档格式:PPT 文档大小:87KB 文档页数:19
为了使设计简化,避免重复的工作,VHDL中 通常使用子结构来规范一些常用的运算或简 单的功能模块;
《电子技术基础》课程教学资源(习题,数字部分)第三章 逻辑门电路习题解答
文档格式:DOC 文档大小:270KB 文档页数:6
3.1 MOS 逻辑门电路 3.1.1 根据表题 3.1.1 所列的三种逻辑门电路的技术参数,试选择一 种最合适工作在高噪声环境下的门电路
信阳师范大学:《电工电子》课程教学资源(实验讲义,打印版)《数字电子技术实验》教案(任课教师:周胜海)
文档格式:PDF 文档大小:2.43MB 文档页数:17
信阳师范大学:《电工电子》课程教学资源(实验讲义,打印版)《数字电子技术实验》教案(任课教师:周胜海)
首页
上页
87
88
89
90
91
92
93
94
下页
末页
热门关键字
语法,语言学
作物
职业发展
优化设计
小组
西南大学
统计原理
塑料成型与设计
软件管理
控制过程
汇编原理
化工设计
工程制图与机械制图
电路基础上
刀具设计
标签设计
贝叶斯分析
J
气浮设备
纳米材料分析
媒介管理
乐理视唱练耳、曲式与作品分析
经济应用数学(一)
检疫管理
基本数据
化工设备
河北大学
工程机械
工程管理
反反复复方法
电梯技术
大学地理
参数化设计
半导体三极
WTO与政府管理
《信号
CAD设计
Internet网络应用
Gauss过程
DSP课程设计
搜索一下,找到相关课件或文库资源
2813
个
©2008-现在 cucdc.com
高等教育资讯网 版权所有