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Active-HDL Design Entry Tools HDL Editor (HDE) State Diagram Editor (FSM) Block Diagram Editor (BDE)
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第一节 VHDL概念 第二节 VHDL语言优缺点 第三节 VHDL建模方法
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VHDL 的构造体基本结构 p.271 表 4-28 architecture arch_name of entity_name is declarations and definitions; 说明部分 begin concurrent statement; 语句部分 end arch_name; 构造体语法要点:
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