1.PLD器件的发展概况 2.可编程逻辑器件的特点 (1)减少系统的硬件规模。 (2)增强逻辑设计的灵活性。 (3)缩短系统设计周期。 (4)简化系统设计,提高系统速度。 (5)降低系统成本

6.18位加法器的设计 1、设计思路 多位加法器的构成方式:并行进位 串行进位 并行进位:速度快、占用资源多 串行进位:速度慢、占用资源少

例12数字钟设计及显示 设计要求 1、具有时、分、秒,计数及数码管显示功能,以24小时循环计时。 2、具有清零,调节小时、分钟功能

6.1 概述 6.2 时序逻辑电路的分析方法 6.4 时序逻辑电路的设计方法 6.3 若干常用的时序逻辑电路 6.5 时序逻辑电路中的竞争-冒险现象

8. 1 概述 8.2 现场可编程逻辑阵列（FPLA） 8. 3 可编程阵列逻辑（PAL） 8. 4 通用阵列逻辑（GAL） 8. 5 可擦除的可编成逻辑器件（EPLD） 8. 6 复杂的可编程逻辑器件（CPLD） 8. 7 现场可编程门阵列（FPGA） 8. 8 在系统可编程通用数字开关（ispGDS） 8.9 PLD的编程

4.1 概述 4.2 组合逻辑电路的分析方法和设计方法 4.3 若干常用的组合逻辑电路 4.4 组合逻辑电路中的竞争-冒险现象

第一章 数字逻辑基础 第三章 组合逻辑电路 第四章 触发器 第五章 时序逻辑电路 第六章 数字系统 第七章 可编程逻辑器件 PLD Programmable Logic Device

2.1 概述 2.2 逻辑代数中的三种基本运算 2.3 逻辑代数的基本公式和常用公式 2.5 逻辑函数及其表示方法 2.4 逻辑代数的基本定理 2.6 逻辑函数的化简方法 2.7 具有无关项的逻辑函数及其化简

1.1 概述 1.2 几种常见的数制 1.3 不同数制间的转换 1.5 几种常用的编码 1.4 二进制算术运算

学习要点： •基本触发器的结构及特点 •触发器的功能描述方法 •触发器的使用方法 5.1 基本触发器 5.1.1 基本RS触发器 5.1.2 钟控RS触发器 5.1.3 D触发器 5.1.4 JK触发器 5.1.5 T触发器和T'触发器 5.1.6 基本触发器的空翻和震荡现象 5.2 边沿触发器