前面所分析的逻辑电路，基于输入/输出都是在稳定的逻辑电平下进 行的，没有考虑动态变化状态。实际上，输入信号有变化，或者某个变 量通过两条以上路经到达输出端。由于路经不同，到达的时间就有先有 后，这一现象叫做竞争

第一章基本知识 本章知识要点 一、数字系统的基本概念; 二、常用计数制及其转换; 三、带符号二进制数的代码表示; 四、常用的几种编码

逻辑(A&F):事物的因果关系,即输入、输出之间变化的因果关系。 逻辑事件(A、F):有且仅有两个相互对立的状态,且必定出现两个状态中的一个

1、熟练掌握基本RS触发器的工作原理、 逻辑功能,及钟控RS触发器、JK触发器、D触发器的逻辑功能、时间波形图、特性方程。 2、理解钟控RS触发器、JK触发器、D触发器电路的工作原理、特点、相互之间的转换及常用JK触发器、D触发器集成芯片的使用。  第1、2学时：基本RS触发器  第3、4学时：钟控触发器  第5、6学时：集成触发器

第一章VHDL的程序结构和软件操作 1-1 VHDL程序的基本结构 1-2软件操作—Max+plusⅡ的操作 第二章 VHDL语言要素 第三章 VHDL顺序语句 第四章 VHDL并行语句 4.1 并行语句概述 4.2 并行信号赋值语句 4.3 进程语句（process） 4.4 元件例化语句 4.5 生成语句（for-generate） 第五章 组合逻辑电路的设计和分析 5.1 概述 5.2 编码器 5.3 译码器 5.4 简单数字显示系统 5.5 其它 第六章 时序逻辑电路的设计和分析 6.2 触发器 6.3 计数器 6.4 分频器 6.5 寄存器 6.1 概述

第一章VHDL的程序结构和软件操作 1-1 VHDL程序的基本结构 1-2软件操作—Max+plusⅡ的操作 第二章 VHDL语言要素 第三章 VHDL顺序语句 第四章 VHDL并行语句 4.1 并行语句概述 4.2 并行信号赋值语句 4.3 进程语句（process） 4.4 元件例化语句 4.5 生成语句（for-generate） 第五章 组合逻辑电路的设计和分析 5.1 概述 5.2 编码器 5.3 译码器 5.4 简单数字显示系统 5.5 其它 第六章 时序逻辑电路的设计和分析 6.2 触发器 6.3 计数器 6.4 分频器 6.5 寄存器 6.1 概述

6.1时序逻辑电路概述 6.2同步时序电路的分析 6.3异步时序电路的分析 6.4同步时序电路的设计方法

4.1.1 基本RS触发器 4.1.2 同步RS触发器 4.1.3 主从RS触发器 4.1.4 主从JK触发器 4.1.5 D触发器 4.1.6 T触发器 4.1.7 触发器逻辑功能的转换

6.1 时序电路概述 6.2 同步时序逻辑电路的分析 6.3 异步时序电路的分析方法 6.4 同步时序电路的设计方法

4.1 概 述 4.2 触发器的电路结构与动作特点 4.3 触发器的逻辑功能及其描述方法 4.4 触发器逻辑功能的转换