实验一基本门电路逻辑功能测试 实验二加法器的设计与应用 实验三译码器和数据选择器的设计及应用 实验四优先编码器的设计(EWB) 实验五触发器的设计及应用 实验六计数器的设计 实验七555定时器

循环码的定义 循环码的生成多项式和校验多项式 循环码的生成矩阵和校验矩阵 循环码的系统码形式 特殊的循环码 循环码的编码电路 用生成多项式的根定义循环码 BCH码 RS码 一般译码原理 捕错译码 大数逻辑译码 仿真流程及Gaussian噪声的产生

一、绪论 二、触发器的电路结构、动作特点 三、基本RS触发器 四、同步RS触发器（钟控RS触发器）

一、循环码译码的原理 二、循环码的译码电路------梅吉特译码法（只纠一个错） 三、扩展汉明码的译码 四、缩短循环码的译码 五、捕错译码——原理 六、大数逻辑译码

7.1集成计数器 7.2集成寄存器和移位寄存器 7.3序列信号发生器 7.4以MSI为核心的同步时序电路的分析与设计

对寄存器所存信息的加工和存储称为寄存 器传输操作 。 用RTL可简练而准确地描述信息流通和信 息处理的情况，是描述各模块内部和模块之 间连接关系的一种很好的方法。 在RTL中寄存器是基本的逻辑单元，并且 是广义的，即：在寄存器传送语言中。术语 寄存器不仅包含普通的寄存器，而且还包含 移位寄存器、计数器、存储器以及其它类型 的寄存器

一、重要的时序电路模块( SEQUENTIAL CIRCUIT MODELS)是构成数字系统和计算机的重要组成部分,主要是寄存器和计数器。 二、寄存器常用于数字系统中数据的暂存和传输。计数器除用于计数外,还对时序电路操作序列的跟踪和控制发挥重要作用。它们同时 都是构成CPU的重要基础模块。 三、通用时序电路模块由门电路与触发器组合构成,其特点是由多个或多级相同的单元电路构成。 四、这些模块可用于构造标准的TTL器件,也可作为VLS设计库中的功能块

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