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系统设计:芯片的功能、尺寸、外部接口、 性能、速度、成本等; 功能设计:系统功能块分割、功能框图 信号流程图、状态转换图等 逻辑设计:各功能块的逻辑表达、逻辑电路图等 功能仿真:不考虑电路连线延时
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第一章作业 1. Top_Down设计方法主要包括哪几个层 次?分别包含什么内容? 2. 什么是IP核?学习VHDL与掌握IP核技 术的关系是什么? 7. FPGA/CPLD的主要优缺点是什么? ASIC的主要优缺点是什么?
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一、对VHDL程序的宏观结构有一个明确的概念性认识; 二、认识实体、构造体的基本格式 三、理解实体、构造体在VHDL程序中的基本功能 四、能够尝试编写简单的VHDL程序
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1.文本编辑:用任何文本编辑器都可以进行,也可以用专用的 HDL编辑环境。通常VHDL文件保存为.vhd文件 2.功能仿真:将文件调入HDL仿真软件进行功能仿真,检查逻辑 功能是否正确(也叫前仿真,对简单的设计可以跳过这一步, 只在布线完成以后,进行时序仿真)
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Process Statement All the Process Statement is executed in parallel Within the Process Statement, the coding is execute in sequential Process Statement is : OUTPUT depends on INPUT with Sensitivity List to control the event happen
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组合逻辑电路设计实例 一、简单门电路 二、加法器 三、编码译码器 四、多路处理器
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一、VHDL描述语句集合的全貌建立一个清晰的概念; 二、对VHDL主要描述语句的作用有一个正确的认识; 三、建立VHDL是一种并行语言的基本概念;
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Combinatorial Logic Combinatorial Logic if – Outputs at a specified time are a function only of the inputs at that time e.g. decoders, multiplexers and adders Output change instantly when input change
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PLD 主要厂商 Altera 公司设计的 EDA 工具,得到广泛应用; 可采用原理图输入和文本输入等多种设计输入方式; 可支持 VHDL、Verilog HDL、AHDL 等多种硬件设计语言; 可进行编辑、编译、仿真、综合、芯片编程等设计全过程操 作; 符合工业标准,能在各类设计平台上运行;
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Behavior Modeling Only the functionality of the circuit, no structure No specific hardware intent For the purpose of synthesis, as well as simulation IN1,…,INn IF in1 THEN OUT1,…,OUTn FOR j IN high DOWNTO low LOOP
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