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《电工技术》PPT教学课件(教案讲稿)第21章 门电路和组合逻辑电路
文档格式:PPT 文档大小:3.02MB 文档页数:141
21.1脉冲信号 21.2晶体管的开关作用 21.3分立元件门电路 21.4TTL门电路 21.5MOS门电路 21.6逻辑代数 21.7组合逻辑电路的分析与综合 21.8加法器 21.9编码器 21.10译码器和数字显示 21.10数据分配器和数据选择器 21.12应用举例
《理工科代数基础》第1次讨论课
文档格式:PDF 文档大小:96.08KB 文档页数:4
Exercise 1 设 a, b, c 是三个不同的数,用 x − a, x − b, x − c 除一元多项 式 f(x) 的余式依次为 r, s, t,试求用 g(x) = (x − a)(x − b)(x − c) 除 f(x) 的 余式
清华大学:《计算机组成原理》第三讲 逻辑电路设计基础
文档格式:PPT 文档大小:2.13MB 文档页数:92
1、组合逻辑电路基础 布尔代数基本公式,逻辑门,卡诺图 2、计算机中常用的组合逻辑电路 一位加法器,译码器,编码器,多路选择器等 3、时序逻辑电路 D锁存器,D触发器,寄存器 4、时序逻辑电路设计 有限状态机,七段显示十进制数双向计数器设计 5、可编程序逻辑阵列(器件)简介
北京邮电大学:《数据库设计与开发》第二章 关系数据库(1/2)
文档格式:PPT 文档大小:478.5KB 文档页数:154
关系模型的理论基础是集合论,是用集合代数定义一个关系。 定义1:域(Domain)是一组具有相同数据类型的值的集合。 定义2:设D1, D2,…, Dn为一组域, D1, D2, …,Dn上的笛卡尔积定义为:
离散时间异质多智能体系统的一致性控制
文档格式:PDF 文档大小:297.37KB 文档页数:6
针对由一阶智能体和二阶智能体组成的离散异质多智能体系统,研究其一致性问题.设计无通信时延和具有有界通信时延时的分布式一致性协议,通过将系统转化为自治的离散时间线性时不变系统,运用矩阵理论和代数图论方法,分析得到系统实现一致性的充分条件.获得的充分条件与采样周期、控制参数和系统的拓扑结构有关.证明了系统的一致性不受有界通信时延影响.数值仿真结果验证了理论结果的正确性
《电子技术》第21章 门电路和组合逻辑电路
文档格式:PPT 文档大小:3.02MB 文档页数:141
21.1脉冲信号 21.2晶体管的开关作用 21.3分立元件门电路 21.4TTL门电路 21.5MOS门电路 21.6逻辑代数 21.7组合逻辑电路的分析与综合 21.8加法器 21.9编码器 21.10译码器和数字显示 21.10数据分配器和数据选择器 21.12应用举例
《计算方法》第四章(4-1)代数多项式插值
文档格式:DOC 文档大小:581.5KB 文档页数:18
一、 Lagrange插值多项式 问题的提出: 设f(x)是区间[a,b]上的一个实函数, x(i=0,1,…,n)是[a,b]上的n+1个互异实数,且已 知y=f(x)在x(i=0,1,,n)处的函数值y(i=0,1,,n) ,即有: yi=f(x),(i=0,1,,n) 现要求一个次数不超过n的多项式P(x),使得 y=Pn(x)(i=0,1,…,n) (*1) 这就是 Lagrange插值问题
《电工技术》PPT教学课件(教案讲稿)第21 章门电路和组合逻辑电路
文档格式:PPT 文档大小:3.02MB 文档页数:141
21.1脉冲信号 21.2晶体管的开关作用 21.3分立元件门电路 21.4TTL门电路 21.5mo门电路 21.6逻辑代数 21.7组合逻辑电路的分析与综合 21.8加法器 21.9编码器 21.10译码器和数字显示 21.10数据分配器和数据选择器 21.12应用举例
西安电子科技大学:《数字电路》课程教学资源(PPT课件讲稿)目录
文档格式:PPT 文档大小:71.5KB 文档页数:3
一、逻辑代数基础 二、组合逻辑电路 三、常用集成时序逻辑器件及应用 四、脉冲波形的产生与变换 五、存储器和可编程逻辑器件 六、集成逻辑门 七、触发器 八、时序逻辑电路 九、用VHDL进行数字系统设计
清华大学:《计算机组成原理》第三讲 逻辑电路设计基础
文档格式:PPT 文档大小:1.44MB 文档页数:61
1、组合逻辑电路基础 布尔代数基本公式,逻辑门,卡诺图 2、计算机中常用的组合逻辑电路 一位加法器,译码器,编码器,多路选择器等 3、时序逻辑电路 D锁存器,D触发器,寄存器 4、时序逻辑电路设计 有限状态机,七段显示十进制数双向计数器设计 5、可编程序逻辑阵列(器件)简介 PLA, PLD
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