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《数字逻辑设计及应用》第7章(7-2) 时序逻辑设计原理(二)

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一、锁存器和触发器 二、同步时序分析 三、同步时序设计
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教字逻辑设计及应用 第7章肘序逻辑设计原理(二) 秦锁存器和触发器 同步时序分析 同步时序设计

第7章 时序逻辑设计原理(二) 数字逻辑设计及应用  锁存器和触发器  同步时序分析  同步时序设计

边沿」K触发器 D Q K DCLK Qb 口QL CLKO Q*=D=JQ+KQ 时钟上升语(正边沿)有效 CLK K 不会出现“箝位”现泉

边沿J-K触发器 Q* = D = J·Q’ + K’·Q 时钟上升沿(正边沿)有效 不会出现“箝位”现象 J K CLK Q QL D Q CLK

T触发器 在每个时钟脉冲有效沿都会改变状态(翻转) T(toggle) Q ENQ具有使能端的 触发器 T Q 卜TQ T触发器 EN /

T触发器 在每个时钟脉冲有效沿都会改变状态(翻转) Q Q T T(toggle) 触发器 EN Q T Q 具有使能端的 T触发器 T Q

利用D、JK触发器实现T触发器 利用D触发器实现。利用]K触发景实现 D: Q*= D JK: Q=J Q+KQ T: Q=Q T: Q*= Q D=Q J=K〓1 QHQ D Q Q T CLK T CLK Q QN K Qp-QN

利用D、J-K触发器实现T触发器  利用D触发器实现 D:Q* = D T:Q* = Q’ D = Q’  利用J-K触发器实现 JK:Q* = J·Q’ + K’·Q T:Q* = Q’ J = K = 1 T Q QN D Q CLK Q T Q QN J Q CLK K Q 1

具有使能端的T触发器的可能电路 功能表 EN Q* EN口 0维持Q CLK Qk 口QN 1翻转Q D: Q*=D EN口 Q 口Q T: Q*=EN.Q+ EN Q TO CLK K Qko口QN JK: Q*=JQ+KQ

具有使能端的T触发器的可能电路 T:Q* = EN·Q’ + EN’·Q 0 1 EN 维持 Q 翻转 Q’ Q* 功能表 JK:Q* = J·Q’ + K’·Q D:Q* = D

其他结构的触发器 维持阻结构 利用门电路传输延迟射间的边泅-K触发器 PRO G3 |≥1 CLRLI Dl oa cLk CLKo +QL K QL G4

其他结构的触发器 维持阻塞结构 利用门电路传输延迟时间的边沿J-K触发器 J CLK K QL Q PRL CLRL CLK D Q QL

锁存器与触发器小结 锁存器和触发器 电平有效和边沿有效的区别 按照逻辑功能的不同特点,通常可分为 S-R触发器(锁存器) 每种触发景的 D触发器(锁存器) 功能表 J-K触发器 特征方程 T触发器 状态图

锁存器与触发器小结 锁存器和触发器 —— 电平有效和边沿有效的区别 按照逻辑功能的不同特点,通常可分为  S-R触发器(锁存器)  D触发器(锁存器)  J-K触发器  T触发器 每种触发器的 功能表 特征方程 状态图

S-R触发器(锁存器) 功能表 时钟S-R锁存器 SRQ基本SR锁存器 00维持 01清0sQ s Q 功能表 10置1 R Qb R Q sR Q 110 00维持 (或非门) 01清0 SLRL Q 主从SR触发器10置1 11维持0dsQ 11|1 01置109R1*60 0清0 001 (与非门) R Q

S-R触发器(锁存器) S C R Q Q 时钟S-R锁存器 0 0 0 1 1 0 1 1 S R 维持 清 0 置 1 0* Q 功 能 表 0 0 0 1 1 0 1 1 S R 维持 清 0 置 1 1* Q 功 能 表 主从S-R触发器 S C R Q Q 1 1 1 0 0 1 0 0 SL RL 维持 清 0 置 1 1* Q 0 1* 0 基本S-R锁存器 S Q R Q (或非门) S Q R Q (与非门)

Q S LR L 低电平有效SR锁存器 00011110 Q 状态转移真值表 0x100 SLRLQn Qn+ 1(× 0001* Q*=SL+R Q 0011米 01 S+ RQ 01 约束条件:SL+RL=1 10 (二者不能同时为0) 10 01010 11 110001 s+R=1+sR=0 111 特征』Q*=S+RQ 方程sR=0(约束条件)

0 0 0 0 0 1 0 1 0 0 1 1 1 0 0 1 0 1 1 1 0 1 1 1 S_L R_L 1* 1* 1 1 0 0 0 1 Q n Q n+1 低电平有效S-R锁存器 状态转移真值表  1 1 0  0 0 1 0 1 00 01 11 10 Qn Q S_LR_L n+1 Q* = S_L’ + R_L·Q = S+ R’·Q 约束条件:S_L + R_L = 1 (二者不能同时为0) S’+R’=1 ➔ S·R=0 特征 方程 Q* = S+ R’·Q S·R=0(约束条件)

S-R触发景(锁存器) 功能表 特征方程 S R Q Q*= S+RQ 00维持 sR=0(約束条件 010 101 111*状态图 S=1R=0 S=0 S=X 0 REX R=0 S=0R=1

S-R触发器(锁存器) 0 0 0 1 1 0 1 1 S R 维持 0 1 1* Q 功能表 状态图 0 1 S=1,R=0 S=0,R=1 S=X R=0 S=0 R=X 特征方程 Q* = S+ R’·Q S·R=0(约束条件)

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